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[参考译文] LMK05318EVM:vco1校准出现问题、检测到 pll1锁定(LOL*)

Guru**** 2595770 points
Other Parts Discussed in Thread: LMK05318

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/789620/lmk05318evm-problem-in-vco1-calibration-and-pll1-lock-detected-lol

器件型号:LMK05318EVM

我使用板晶体校准作为主时钟、vco1的公式和中心频率都满足进入 freerun 模式的要求。 然而、当 LED 灯的状态被调整为 PLL1 VCO 校准激活时、它不会亮起。 即使通过 pll1powerdown 手动调节、表示 pll1 VCO 校准有效的 LED 指示灯也只闪烁一次。但是、当我级联 apll2 xo 时、来自 pll2 VCO 校准有效的指示灯将打开、 当我将 apll2级联到 apll1时、来自 pll2 VCO 校准有效的光也会被关闭。

此外、在我连接基准后、使用了 DPLL 和 apll1级联。 当 LED 指示灯为默认值时、可以满足 DPLL 锁定要求、 LED 灯被回转以指示 pll1 VCO 校准激活和 pll1锁定被检测到(LOL*),它们仍然不亮,基于下面的微型,探测到 pll1 VCO 校准和 pll1锁定是第一步和第二步,但它们不起作用,这些现象意味着什么?


  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好、Haifeng、

    您是否设计了自己的 LMK05318 EVM? 还是只测试 TI 的 LMK05318EVM?

    如果您有新的 LMK05318设计、请分享原理图。 我们可以为您进行检查。

    让我们知道您的输入时钟频率、本地 XO 频率和输出频率。

    然后、LMK05318需要正确的寄存器设置、请参阅附件指南。

    您可以使用 GUI TICS Pro 生成和保存寄存器设置。 可以共享.TCS 文件进行检查。

    通常、在调试中、我们将读取状态寄存器、如 TICS Pro 状态页面所示。

    引脚控制 LED 指示灯或 DIM 仍取决于寄存器设置和二极管朝向 VDD 的方向。 我无法判断您的设计有何含义。

    需要澄清的一点是:

    PLL1 VCO 校准激活:仅 当 PLL1 VCO 校准正在运行时有效。 校准完成后、断言状态将被删除。

    希望这些评论能为您提供帮助。

    此致、

    肖恩

     e2e.ti.com/.../LMK05318_5F00_GUI_5F00_Quick_5F00_Start_5F00_Guide_5F00_08_2D00_24_2D00_2018.pdf

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    肖恩、
    感谢您的回复、我只是测试 TI 的 EVM。我想让输出波具有与我的基准输入相同的频率和相位。
    我使用10MHz 单端方波作为 priref_P 的参考、并将 priref_N 连接到灌浆。我使用的 xo 是 EVM 板上的晶体振荡。但是、当我使 LED 指示检测到的 PLL 锁定(LOL*)时、它永远不会亮起。输出波形没有与相同的相位 通过 LED 的参考显示 DPLL 频率锁定和相位锁定。

    当失去参考时、它们的相位差开始发生变化、即使我给了一个大调优历史字时间。

    这是我的 TCS 程序、其格式为 txt。

    非常感谢。

    此致、

    海峰

    e2e.ti.com/.../haifeng.txt

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    您好、Haifeng、

    1、"读取状态"、以显示 LMK05318状态、捕获该屏幕。 确保 LMK05318 PLL 处于锁定状态。

    2、"OUT7通道具有可选的零延迟模式(ZDM)同步功能、可支持确定性输入到输出相位对齐"

    但电流 OUT7为156.25MHz、不是基准10MHz 的倍数。 您可以找到 确定性输入到输出相位对齐。

    其他输出通道不支持 ZDM。

    3、在"Start Page"中、启用"DPLL_ZDM_SYNC_EN"并调整偏移、以获得所需的相位。 (几乎位于 TICS Pro 页面的底部)

    此致、

    肖恩

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    谢谢 Shawn、我很感动您的帮助。

    但是、当我读取状态时、就像下图所示、我不使用 apll2、因此 LOL_pll2有一个检查、但在 INTR 粘滞状态中失败的检查结果是什么?这是否意味着出现了错误?

    此外、您是否意味着只有 ZDM 模式才能使输出波形相位与基准同步?

    再次感谢。

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    我还想知道、当使用 ZDM 时、何时正确配置了其他内容。如果基准电压丢失、输入到输出相位对齐是否会持续一段时间?或者基准电压和输出相位同时发生变化? 非常感谢。
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    您好、Haifeng、
    请参阅左侧的"INTR 源实时状态"和"其他状态寄存器"、状态看起来正常。 LMK05318已锁定。
    当 ZDM 被启用时、OUT7与基准有多个关系时、它们可以有一个确定性相位关系。

    如果基准丢失、LM05318将进入保持模式、频率稳定性取决于电路板振荡器。 当发生基准损耗时、瞬态中的输出相位跳变可被控制在小于+/- 100ps 的范围内(取决于配置)。 之后、输出时钟将随板载振荡器漂移。

    此致、
    肖恩