您好!
我设置 lmk04828单环路0延迟、并将 FB_MUX_EN ALD PLL2_NCLK_MUX 更改为与数据表的表8相同的值。
OSCin 为288MHz、VCO 选择为2592MHz。
DCLKout 上的 I 预期288MHz (时钟分频器= 9) 9MHz SDCLKout (SYSREF 分频器= 288)
然而、DCLKout 的输出 大约为296MHz、SDCLKout 大约为9.26MHz
我应该如何获得正确的输出?
我附加了 TCS 文件和屏幕捕获文件。
e2e.ti.com/.../LMK04828_5F00_oscin_5F00_single_2D00_loop_5F00_2022_5F00_1121_5F00_sysref.tcs


此致、
YS
