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[参考译文] CDCI6214:如何实现 PLL 抖动? 和 CH3/4 IOD 问题

Guru**** 2409380 points
Other Parts Discussed in Thread: CDCI6214, LMK03318, LMK03328

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/726291/cdci6214-how-to-impove-pll-jitter-and-ch3-4-iod-problem

器件型号:CDCI6214
主题中讨论的其他器件: LMK03318LMK03328

您好!

这是 CDCI6214的测试配置 。

XIN=27MHz & Fvco=2691.562500MHZ 不能改变。μ s

我们必须至少使用3 个 CDCI6214 的 IOD...

我有两个问题。

1) 1)如何实现 CDCI6214 PLL 抖动?

我修改了 PLL_IF_pcap\zcap\res,然后  按“re-CAL”  或   复位 IC 和“write all regs”。

测量到的148.5MHZ (CH1/2)抖动没有明显变化?

   对于 Fvco=2691.562500MHZ?、是否有任何推荐的 PLL 配置

2)  2) CH3/4 IOD 问题

IOD1~4具有相同的设置。

CH1/2是 正常 输出。Ω

CH3/4 在软件中是正确的。 但 实际上输出是168.228876MHZ?

Thx、

全部

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    请参阅有关 CDCI6214和潜在解决方案的主题:
    e2e.ti.com/.../2512845。

    由于分数输出分频器中的固定分母、可能会产生非零 ppm 合成误差、因此 CDCI6214可能不适合生成148.5/1.001 MHz 等同步视频时钟。 您可能需要考虑其他具有分数 N PLL 的时钟发生器、例如 LMK03318或 LMK03328、以便在不产生合成误差的情况下将27MHz 输入转换为148.5 (/1.001) MHz 输出。

    Alan
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    您好,
    今天,我解决了问题2....
    软件错误.. 在遵循特殊配置过程时,CH3/4已完成!...

    对于 Fvco=2691.562500MHZ?、是否有任何推荐的 PLL 配置

    Thx、
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    我不建议使用 VCO 频率、因为它需要低 PFD 频率(1.6875MHz)、这会降低抖动性能。

    您能否使用2673MHz 的 VCO 频率和13.5MHz 的 PFD 频率来使用整数输出分频器获得148.5MHz 的输出? 这将提供更好的性能。

    Alan
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    您好!

      请。CDCI6124 μ F 的"周期到周期抖动"和"周期抖动"参数

      上述配置具有大量抖动。

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    您能否发送您测试过的 TICS PRO TCS 文件? 我们团队的某个人将在下周初跟进。

    Alan