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[参考译文] CDCI6214:客户遇到设计问题、如 ABELow。

Guru**** 2585785 points
Other Parts Discussed in Thread: CDCI6214

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/732689/cdci6214-customer-have-design-issue-as-abelow

器件型号:CDCI6214

您好的团队:

您能回答设计问题吗?

客户使用 XTAL 25MHz 作为 CDCI6214 输入。

    检查 CDCI6214是否可以同时产生差分54M (Y1)、25M (Y2)、50M (Y3)。

状态    、OE、REFSEL 引脚如何在我们的应用中进行配置。

如果    是第一次使用、且 EEPROM 为空、则状态是什么。 我们担心这一点、因为其中一个 CLK 是生成馈送 CPU 的。

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    1.可以。 请参阅以下内容:

    2.对于 XTAL 输入、我建议通过4.7K 电阻将所有 REFSEL 引脚置为低电平。

    您可以将 GPIO1和 GPIO4配置为输入或输出。

    当配置为输入时、您可以设置为全局输出使能或单独输出使能。 您还可以将其设置为 SSC 启用或频率递增/递减。

    当配置为输出时、它是一个状态引脚、可用于监控器件状态、例如 PLL 锁定和校准状态。 您还可以查看 I2C 信号和内部时钟波形的缓冲副本。

    默认情况下、GPIO1和 GPIO4配置为输出。 GPIO1是全局 OE、GPIO2是 EEPROM_BUSY

    此致、
    通道