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[参考译文] LMX2820EVM:分数 N 模式下的较大移动杂散。 外部 VCO

Guru**** 2387080 points
Other Parts Discussed in Thread: LMX2820
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1218311/lmx2820evm-large-moving-spurs-in-fractional-n-mode-external-vco

器件型号:LMX2820EVM
主题中讨论的其他器件:LMX2820

我已使用 HMC1169在外部 VCO 模式下测试用于 LMX2820的评估板、并选择了分数 N。 工作频率为13.125GHz、基准为100MHz (加倍以获得200MHz PFD)、三阶有源环路滤波器、MASH=3。 根据仿真结果、PLL 锁定和相位噪声效果与预期大致相同。 我注意到、边带杂散电平似乎可以通过 MASH 顺序和 PFD-DLY 设置进行管理。 精密泵和滤波器带宽也将得到优化、以帮助实现这一点。

 但是、在使用分数 N 操作时、我遇到了我在使用另一个 PLL 器件(ADF4371)时不知道的情况 在观察 LO 信号周围的频谱分析仪(1MHz 跨度、30kHz RBW)时、在没有启用平均值的情况下、我可以看到 PLL 通带内的"移动"杂散。 当接近 LO 信号时、其电平大约为-45dBc。 它与扫描载波频率类似、可能在十分之一秒内通过频带快速传输;它会自行重复、 每隔几秒再次运行一次。 将迹线模式设置为最大值时、很难在显示屏上一致地捕获这些信息、但相关证据很明显。 使用数秒内的最大迹线设置、频谱分析仪显示屏幕将填充高达-45dBc 的波形以及+/-400kHz 范围内的移动杂散包络。

在另一个 PFD_DLY 设置下、杂散电平可以在一定程度上降低。 行进杂散变小、但固定杂散会增加

在整数 N 模式下运行时、移动杂散不出现、因此我认为这是由于某种数值累加而在分数 N 计算中出现的移动拍频。

尝试调整分子、分母、MASH 顺序和 PFD 延迟、但没有明显的方法来消除它。 PFD 延迟设置确实会改变其电平、但代价是 增加普通固定杂散。

我希望这是我错过的一些简单内容、但到目前为止 TI 文档中没有看到这一点。

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    您好!

    在本例中、环路 BW 是什么? 在我看来、杂散似乎在环路带宽内。

    在外部 VCO 操作下、应根据下表手动设置 PFD_DLY。 在本例中、它会突出显示为红色部分。

    请尝试对所选 MASH_ORDER 保持上述 PFD_DLY 设置并查看性能。

    谢谢!

    此致、

    阿杰特·帕尔

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    您好、Ajeet、

    感谢您的答复。

    我找到了一种方法来消除在频谱显示屏上看到的移动杂散(1MHz 跨度、30kHz RBW)。 我必须将分母的小数设置为10的幂。 我想、任何其他分母都会再次引起移动杂散。

    我注意到了表7-9中 PFD_DLY 与 MASH 顺序和 fRFin/(RFIN 分频器)的值。 为了实现稳定运行或最佳性能、这些设置是必须的吗? 我提出问题的原因是、我发现其他 PFD_DLY 设置允许低于200kHz 的杂散比使用表7-9中的值时略好。 实际上、我找到的 LO 频率最佳设置是迄今为止我曾尝试将杂散降低至-65dBc、但表中的值可能会导致我生成的 LO 产生超过-60dBc (我的应用的最大值)的杂散。

    关于减少环路滤波器 BW (在本例中约为200kHz)内的杂散、您是否有相关指导?

    谢谢!

    Leonard Cordingley

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    您好、Leonard、

    我们将于周一有更多的射频专家返回办公室、因此您可以期待 Ajeet 或其他团队成员的回复。

    此致!

    Evan Su

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    您好、Leonard、

    PFD_DLY 用于优化杂散和相位噪声。 因此、如果它具有外部 VCO、建议使用表7-9、因为 PFD_DLY 不能像在内部 VCO 的情况下那样进行内部调整。

    您可以在调整 PFD_DLY 并能够减少杂散的同时进行权衡。

    谢谢!

    此致、

    阿杰特·帕尔