[参考译文] LMK00105：固定输出、功率序列要求

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请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1319981/lmk00105-fixed-output-power-sequency-requirement

器件型号：LMK00105

您好、团队成员：

下面我对 LMK00105有疑问。您能在下面回答一下吗？

如果我们强制 OSCin 为固定逻辑高电平并且输入 SEL 选择 OSCin、我是否可以预期输出为固定逻辑低电平？
该器件是否有 Vdd 和 Vddo 之间的电源序列要求？

此致、

1 年多前

0 admin 1 年多前

TI__Guru**** 2589820 points

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您好 Taketo：

下周同一时间再见。

此致！

安德烈亚

0 admin 1 年多前

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您好 Andrea San：

感谢您的支持。我等待您的提示确认。

此致、

0 admin 1 年多前

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您好 Andrea San：

您能否支持有关此 LMK00105的信息？

此致、

0 admin 1 年多前

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您好 Taketo-San：

user5108279 说：
如果我们强制 OSCin 为固定逻辑高电平并且输入 SEL 选择 OSCin，我是否可以预期输出为固定逻辑低电平？

当选择了晶振模式并且没有 AC 信号被施加到 OSCin 时、这个问题是正确的、如数据表第10页中所解释：

user5108279 说：
设备是否有 Vdd 和 Vddo 之间的电源序列要求？

不应存在特定的电源时序。您是要求仔细检查是否没有一项、还是您在该流程中看到了任何怪异的行为？此外、如果有兴趣的话、还认为我添加了数据表第9页中有关 Vdd 和 Vddo 的详细信息的快照。请特别注意以下注意事项：

此致！

安德烈亚

0 admin 1 年多前

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您好 Andrea San：

感谢您的评论。

数据表中没有电源序列要求声明、但 Vddo 之前的 Vddo 可能会对内部 ESD 结构造成损坏、因此通常建议在 Vddo 之前或 Vddo、Vddo 与 Vddo 同时加电、以避免注释说明、正确吗？

此致、

0 admin 1 年多前

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您好 Taketo：

而不是说 Vddo 需要在 Vdd 之前加电。数据表中的意思是、电压 (并非为了 Vddo/Vdd 是打开状态)必须低于 Vdd 电压。因此、无论 Vdd 还是 Vddo 是先供电、都不应影响 ESD 结构。

0 admin 1 年多前

TI__Guru**** 2589820 points

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您好 Andrea San：

不好感谢你的评分抱歉、让我再次询问用于再次检查的电源序列。

Unknown 说：
因此无论 Vdd 还是 Vddo 是先加电，都不应对 ESD 结构产生影响。

首先为 Vddo 供电、然后它将创造比 Vdd 电压更高的 Vddo 电压条件、直到 Vdd 通电。通过说明、我假设 Vddo 和 Vdd 之间有保护二极管。如果出现 Vddo > Vdd+0.3V 的情况、则保护二极管可能会损坏。我的理解错了吗？

此致、

0 admin 1 年多前

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您好 Taketo：

这是一个我没有考虑的好问题。明天他们回到办公室后、我将再次与我的团队进行确认、并与您联系。

0 admin 1 年多前

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您好 Andrea San：

感谢您与您的团队的反复核对。我等待团队的反馈。

此致、

0 admin 1 年多前

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您好 Taketo：

抱歉造成任何混淆。正确、Vdd 电压需要在 Vddo 之前通电(在发布后校正、因为客户犯了错误)、否则会损坏 ESD 内部电路。如果仍有不清楚的地方、请告诉我。

此致！

安德烈亚

0 admin 1 年多前

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您好 Andrea San：

我了解建议的序列、先是 Vdd、然后是 Vddo。

(可能您在之前的回复中有拼写错误、但我理解。)

此致、

时钟和时序（参考译文帖）

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[参考译文] LMK00105：固定输出、功率序列要求