[参考译文] LMH1983：LMH1983 PLL4、48MHz

admin

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https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1401080/lmh1983-lmh1983-pll4-at-48mhz

器件型号：LMH1983

工具与软件：

我想使用来自 PLL1的27MHz 输入在 PLL4上生成48MHz 时钟。 PLL4是否能够设置为在48MHz 下运行？

我已经审阅了 AN2108示例来生成44.1kHz、但是在论文中计算和提供的值实际上并不会生成44.1kHz。在那张纸上有错误吗？

5 个月前

0 admin 5 个月前

TI__Guru**** 1821780 points

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Jerry、您好！

我们可以设置 PLL4_DIV 来获得48kHz。

0 admin 5 个月前

TI__Guru**** 1821780 points

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尊敬的 Noel：

我制作了一个拼写错误。我尝试生成48MHz。我曾尝试将 PLL4_DIV 更改为1、因此输出为98.304MHz /2 = 49.152MHz (通过测量验证)。然后、我尝试调整 VCO 范围以实现48MHz、但分辨率过于粗略、而且在看起来接近48MHz 的设置下、PLL4锁定不稳定、表示可能不稳定。

VCO RNG = 0x1E、PLL4_OUT = 48.304MHz

VCO RNG = 0x1F、PLL4_OUT = 47.87MHz

0 admin 5 个月前

TI__Guru**** 1821780 points

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Jerry、您好！

从 PLL4方框图中、我们可以推导出两个方程。

27MHz / R = VCO / N / 8 - eq#1

VCO / 3 / IS125M / 2^PLL4_DIV = fout - eq#2

假设 fout = 48MHz、VCO = 1.3GHz 至1.69GHz
重新排列 eq#2
VCO =输出 x 3 x IS125M * 2^PLL4_DIV
尝试 IS125M = 4
VCO = 48M x 3 x 4 x 2^PLL4_DIV
= 576M x 2^PLL4_DIV
=无解决方案
尝试 IS125M = 5
VCO = 48M x 3 x 5 x 2^PLL4_DIV
= 720M x 2^PLL4_DIV
如果 PLL4_DIV = 1
VCO = 720M x 2.
= 1440MHz

由于芯片设计为默认27M/75 = 360kHz、
尝试 R = 75
使用 eq#1找出 N
360k = 1440M/N/8
N = 500

时钟和时序（参考译文帖）

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