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https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1498913/adc3662-clkp-clkm-driver
工具/软件：
您好、
我想将 ADC3662连接到 FPGA、但我正在努力找到如何驱动采样时钟输入 CLKP、CLKM。
为了获得最佳性能、我必须使用哪些逻辑电平和/或驱动器？ 我阅读了数据表、但没有包含适当元件的原理图示例。
您能发送更多详细信息和一些示例吗？
谢谢你
Petar
尊敬的 Petar：
如果您计划获得 ADC3662的性能、我建议不要将 FPGA 用作时钟。
这些器件会给 ADC 增加过多的噪声和抖动并破坏性能。
有关这一点的更多信息、请参阅以下链接： www.ti.com/.../sbaa653.pdf
您可以通过 LVDS 或双正弦波或 CML 或 PECL 等时钟标准连接到 ADC 的时钟引脚。
如需 TI 提供更多时钟建议、请告知我们。 我们当然也可以在这方面帮助你。
谢谢、
Rob
您好 Rob、
谢谢您提供的链接、但我阅读了该文档。
我们的应用对抖动不是很敏感、它的空间非常有限、这意味着芯片尺寸不能超过3mm x 3mm。
您提到 LVDS 信号、但通常是 mV、由于中点基准、我们是否需要串行电容器？
您是否有任何具有不同选项的原理图/接线示例、我很高兴考虑使用任何 TI 时钟解决方案、例如驱动器或接口转换器。
您提到时钟的正弦波！？ 它如何满足高偏斜要求？
是的、使用串联电容器对 VCM 进行直流时钟。
这里是接口线路：FPGA - DIFF 布线-每个 DIFF 布线上的串联电容器- DIFF 100欧姆端子- ADC 时钟输入引脚。
串联电容器和100 Ω 差分端应靠近 ADC。
例如、您可以查看 ADC366x EVM 原理图。 只需下载 EVM 的设计文件。
对于正弦波问题、这意味着压摆还是偏斜？ 如果您计划在最后使用 FPGA、则无需使用此接口
此致、
