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[参考译文] DAC37J84：DAC37J82报警/ DTest输出

admin
Guru**** 2502465 points


请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/566173/dac37j84-dac37j82-alarm-dtest-output

部件号：DAC37J84

当我对DAC进行编程以输出Block0 PLL时钟/80时，似乎没有从报警引脚中得到任何东西。

我通过写入0x0100到SPI上的0x1b地址来执行此操作。

我的SerDes PLL应以2.4GHz运行，因此我希望在报警引脚外看到30MHz。

是否需要配置其它寄存器才能使PLL时钟超出报警引脚？

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    TI__Guru**** 2502465 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    伊恩

    在config0中设置位4高以启用报警引脚。

    此致，

    Jim  

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    TI__Guru**** 2502465 points
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    不幸的是，我仍然什么也没有得到。
    警报输出已启用，极性为正逻辑。
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    TI__Guru**** 2502465 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    除了设置config0以启用正确极性的报警输出外，
    我认为还必须配置config60以启用时钟输出(ENDIVCLK)。
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    TI__Guru**** 2502465 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    伊恩

    您还必须取消对PLL锁定的屏蔽，该锁定在默认情况下会被屏蔽。 写一个ff00到config5，然后尝试一下。

    此致，

    Jim