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[参考译文] ADS1278EVM-PDK:电路板问题

Guru**** 2560390 points
Other Parts Discussed in Thread: ADS1278, ADS1278EVM-PDK

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/576653/ads1278evm-pdk-board-issues

部件号:ADS1278EVM-PDK
主题中讨论的其他部件:ADS1278

大家好,我一直在测试ADS1278 EVM,将其作为独立的PCB板(直到我能够为我们嘈杂的电路板设计新的电路板),以便进行开发,但我一直无法从中提取任何数据。 为了进行测试,该板处于低速模式(模式[1:0]=11,CLKDIV =0),接口协议设置为SPI,DOTout模式设置为TDM,数据位置设置为动态(格式[2:0]=000)。 S6开关设置为“上”SPI设置, 而S2上的F2-F0开关则“下”切换到主板中心。  我正在从处理器(4.17 的针脚31AD 4.18)提供1MHz的外部时钟,并以500 KHz的频率运行SPI,CPOL,CPHA =0,0。

当我使用4.15 的下降沿触发中断来确定何时读取DOUT1引脚上的数据时,JP1和JP2是打开的。 JP4也可用于时钟源的硬件选择,而JP5短路则允许选择外部时钟源。  

提供电源后,/DRDY引脚似乎显示了ADS1278数据表第30页图76中预测的行为。 但是,当我检查DOUT1引脚的输出时,无论参考电压设置或我使用的输入/通道如何,我似乎都没有获得任何数据(测试时相关通道均已通电)。 我无法确定为什么在EVM板上而不是在我们自己的内部板上发生这种情况。 感谢你能抽出时间。  

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    你好,Nikolas,

    感谢您的帖子。 听起来,您已经正确配置了所有功能,以便将ADS1278EVM-PDK的子板用作独立板。 我感觉端口扩展器(U7和U8)正在通电,因此部分或全部格式[2:0]的针脚被拉高/低-这将覆盖S2交换机上的设置。 我尝试以与您相同的方式配置自己的EVM,发现格式[2]仍被高推至IOVDD,后者将器件置于帧同步接口格式。

    您是否可以探测设备引脚以验证格式[2]是否全部为低电平? 此外,继续探测CLK和/DRDY,以确保设备正在接收外部CLK并进行转换。

    此致,

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    您好,Andrew,很抱歉回复太晚(我们继续为我们的产品设计一个新的,噪音较低的内部主板),但感谢您的帮助。 我们确实购买了另一个开发板供以后使用,它似乎可以正常工作(与以前相同的连接,但/DRDY引脚保持高位-这意味着它不会显示SCLK保持低位时第30页图76中所示的行为)。 就像您提到的主板一样,无论交换机S2的设置如何,此处的格式引脚都保持高电压。是否有解决方法? 我们感谢您的帮助!
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    你好,Nikolas,

    我唯一的建议是,要么去除了端口扩展器集成电路,要么切断它们的踪迹。 请注意,您将不再能够使用EVM软件来配置ADS1278 -而是必须依赖S2交换机。

    此致,