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https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/624836/ads52j90-relation-between-sysref-and-lmfc
您好，
我的客户正在使用ADS52J90。
我的客户认为SYSREF时钟的频率必须是LMFC时钟的多频率。 如果SYSREF时钟的频率不是LMFC时钟的多个频率，会发生什么情况？
此致， Shimiuz
嗨，Shimizu-san，
我们已收到您的咨询，并将在本周结束时回复您。
此致，
奥卢
感谢您发送电子邮件。 如果SYSREF频率不是LMFC频率的倍数，则可以在多帧中间断言SYSREF，这可能导致JESD设备重置，并且链路不会出现。
嗨，Shimizu-san， JESD块是指第49页上的图72所示的JESD TX块。 具有不是LMFC频率的倍数的连续SYSREF信号意味着每次在设备时钟的上升沿处采样SYSREF时，JESD链路都必须持续重置LMFC的相位，即不断重新启动中的多帧 另一个多帧的中间。 JESD204B标准介绍了有关SYSREF，LMFC和多帧对齐的更多信息。 此致， 奥卢
您好，Olu-san，
感谢您的回复。 为了理解您的答案，我会提出其他问题。
问题1：如果连续SYSREF信号是LMFC频率的倍数，JESD块是否复位？ 问题2：如果重置发生在具有连续SYSREF信号(LMFC频率的倍数)时，ADS52J90和FPGA是否会重新协商链接？
此致， Shimizu
如果您想更深入地了解SYSREF在JESD204B中的工作方式，我建议您学习 此 材料。
此外，大多数FPGA供应商(Altera，Xilinx)都有自己的专有IP来确定FPGA，JESD TX交互。
