使用ADC08D500对模拟信号进行采样时出现问题。 将DES模式设置为操作模式和1Gsps采样率,并使用FPGA获取ADC数据。该电路用于测量信号延迟。
ADC输出时钟为250MHz并连接到FPGA。 使用FPGA内部PLL延迟时钟 相位0,9018.027万 度和获取四个时钟,这些时钟为计数器提供。最后,将四个计数器的值作为延迟时间的结果相加。
如果延迟为100ns,则测量结果为90ns,
如果延迟为200ns,则测量结果为200ns
如果延迟为300ns,则测量结果为305ns
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