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[参考译文] ADS1602:初始化ADC的同步脉冲太长

Guru**** 2595805 points
Other Parts Discussed in Thread: ADS1602

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/660175/ads1602-initializing-sync-pulse-to-adc-too-long

部件号:ADS1602

我注意到ADC需要在其同步引脚上进行脉冲。 数据表中有最小脉冲宽度(时钟周期),但没有最大 对于我们目前拥有的处理器,我们可以为引脚提供的最快脉冲大约为6US,其中ADC的时钟周期为62.5ps。 使用这种明显更长的脉冲,我们无法正确初始化系统。 同步脉冲太长是否存在问题,或者我们的问题是否是其他问题?

谢谢

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    您好,Jesse:

    感谢您的帖子!

    我必须与设计师确认,但我的猜测是,同步脉冲持续时间可能超过1个时钟周期,而不会导致问题。 通常,同步输入保持高电平,以暂停转换,直到释放SYNC。 这将强制系统中的所有ADC在完全相同的时钟边缘上开始转换(假设它们都共享SYNC和CLK)。

    SYNC和CLK之间的信号边缘关系可能比同步脉冲宽度本身更重要。 原因是,在释放同步PIN时,您希望所有ADC都能识别事件并同时开始转换。 如果未遵循设置和保持计时规范,则一个ADC可能开始转换其它ADC之前/之后的一个时钟周期。

    顺便说一下,ADS1602不支持62.5 ps时钟周期(16 GHz)! 我想您指的是62.5 ns?


    此致,

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    Ryan,

    感谢您的回复。 我们只使用一个ADC,因此多个ADC的同步应该不是问题。 但是,如果我们不能正确获取CLK和同步之间的边缘关系,这是否仍会影响我们使用单个ADC? 是否必须严格按照数据表中的规定进行? (在这种情况下,同步的上升边缘= CLK的下降边缘,同步的下降边缘=下一个CLK周期的下降边缘)

    谢谢!

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    您好,Jesse:

    只要你遵循一个时钟周期的最小脉冲宽度,我就不相信。 让我确认一下并回复您。
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    做了更多的研究后,您似乎是对的。 无论是否使用同步脉冲,ADC本身都应该输出串行数据,因为同步脉冲只是确保所有数据都同时启动。 我们遇到的问题是,我们有一个脉冲,它工作正常,经过更多的测试,它停止工作。 我们不确定是不是因为我们的脉搏,所以我想检查一下。 因为它看起来不是脉搏,我担心我们的ADC可能会受到某种程度的冲击。 您是否知道我们可以对ADS1602进行故障排除以查看其是否仍可正常运行(除了查看数据外)的任何方法? 现在,在进行所有操作后,我们没有从任何串行输出端口(如SCLK,FSO,DATA,OVR)获取数据。  

    谢谢!

    杰西

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    您好,Jesse:

    很遗憾听到您仍然遇到此设备的问题。

    您能否提供RBIAS和/REFEN设置?

    要验证芯片的完整性,我需要将/REFEN设置为“LOW”(低)并探测以下电压:VREFP,VMID,VREFN,VCAP和RBIAS。 如果您使用的是内部参考,则VREFP,VMID和VREFN应在电气特性表中详述的范围内。 RBIAS的值对内部产生的偏置电压有影响,包括参考电压,因此我将尝试收集更多详细信息,了解您应该在VCAP和RBIAS引脚上测量的电压。

    此致,
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    您好,Jesse:

    我刚刚从设计师那里收到了一些更多的信息。 VCAP的标称电压为3.8 V,而RBIAS的标称电压为1.6 V

    此致,
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    您好,Andrew,  

    感谢您的回复。 RBias 140千欧姆,而REFEN则较低。 通过这种方式,我们可以探测VREF电压,并且软管的电路板上都有0V电压,因此看起来它肯定是油炸的。 我们只是将它发送出去,以便放置一个新芯片,因此我们将再次尝试。 我们不确定是什么原因导致了它炸薯条,但我们将格外小心,以正确连接所有东西,并确保防止任何我们可以做到的ESD。 当我们取回主板时,我们将使用您列出的电压验证我们的电压。  

    谢谢!

    Jesse Hawkins