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[参考译文] DDC112:CH1或2的输出时序。

Guru**** 2517850 points
Other Parts Discussed in Thread: DDC112

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1021837/ddc112-output-timing-for-ch1-or-2

器件型号:DDC112

大家好、

我想知道输出数据时序。

如果 CH1和 CH2上同时存在输入信号、则转换哪个通道?
是否有优先级?

此致。
Kengo。

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    尊敬的 Kengo-San:

    感谢您发帖。  

    对于哪个通道被转换没有优先级。 每个 DDC112输入有两个积分器(积分器1A/1B 和积分器2A/2B)、这两个积分器将根据 CONV 信号持续对输入通道进行积分。 当 DDC112处于连续集成模式时、来自两个输入的一侧的积分器输出将被数字化、而另外两个积分器处于集成模式。 有关连续模式下 DDC112的积分和转换时序、请参阅数据表的图2。 每个信号输入的 A 侧和 B 侧的结果存储在输出移位寄存器中、并在 DVALID 输出变为低电平时有效。

    谢谢

    -TC

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    尊敬的 TC-SAN:

    感谢你的答复。
    我对你的评论有疑问。

    是否有办法确定输出数据是 IN1还是 IN2?
    并且、是否可以将输出数据指定为仅 IN1?

    此致。
    Kengo。


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    尊敬的 Kengo-San:

    有关 DDC112的数据输出方案、请参阅下图(图22)。 IN1和 IN2输出数据都需要通过 IN2输出数据位后跟 IN1输出数据位从 DOUT 串行检索。 没有选项只指定用于检索的特定通道。  

    谢谢

    -TC

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    TC-SAN、

    感谢你的答复。

    当/DXMIT 被设定为低电平时、这是否意味着 IN2数据一直被输出?

    此致。
    Kengo。

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    尊敬的 Kengo-San:

    /DXMIT 的下降边沿与 DCLK 相结合将启动数据的串行传输。 IN2通道数据将首先输出、然后是 IN1通道数据。谢谢

    -TC  

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    尊敬的 TC-SAN:

    感谢你的答复。

    /DXMIT 和 DCLK 的下降沿时、是否 有从通道1读取的内容?

    此致。
    Kengo。

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    尊敬的 Kengo-San:

    很抱歉,你能否澄清问题,因为我不清楚问题是什么?

    谢谢

    -TC

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    尊敬的 TC-SAN:

    是否可以如下图所示输出通道?
    我想知道、CH1可能会首先输出。



    此致。
    Kengo。

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    尊敬的 Kengo-San:

    感谢您的澄清。 遗憾的是、没有使用您显示的方案检索数据的选项。  

    谢谢

    -TC

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    尊敬的 TC-SAN:

    感谢您的评论。

    不幸的是、我的客户看到 CH1和 CH2被反转的现象。
    我连接了波形。
    e2e.ti.com/.../210802_5F00_DDC112U_5F00_Waveform.pdf

    这种现象很少发生。
    当电源重新启动时、它会恢复、但发生时、通道会反向输出。

    此致。
    Kengo。

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    尊敬的 TC-SAN:

    这是怎么回事?
    我将等待您的回复和评论。

    此致。
    Kengo。

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    尊敬的 Kengo-San:

    很抱歉、我错过了您之前的帖子。

    我不确定输出数据是如何被反转的。 我将与团队核实、看看是否有这种现象的解释。

    您能否提供有关器件工作条件(续/续模式)的更多信息? 如果您可以在示波器图上显示 CONV 和 DVALID 信号、那将非常有用。 此外、对于正常和异常情况、请在同一示波器捕获图上显示 A 侧和 B 侧数据。

    谢谢

    -TC

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    尊敬的 Kengo-San:

    感谢您的耐心等待。 我已经和团队讨论过、他们看到的现象可能是由于 CONV 信号在上电条件下的行为。 请参阅以下 E2E 帖子、了解更多信息和建议。

    https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/164230/ddc112-dvalid-signal-to-early---exchanged-channel-data

    谢谢

    -TC

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    尊敬的 TC-SAN:

    感谢你的建议。
    未使用的端子(IN2/28pin)是否应该被固定在低电平来满足电源序列?

    此致。
    Kengo。

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    尊敬的 Kengo-San:

    所有未使用的数字和模拟输入引脚必须在器件上电序列之前为低电平。

    谢谢

    -TC

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    尊敬的 TC-SAN:

    我还有其他一些问题。

    在上电序列中、VREFpin 是否为低电平?
    2.电路下面是否正常?
      我认为在上电序列时、它不能固定为低电平。


    3.您能告诉我上电后 CLK 的输入时序吗?

    此致。
    Kengo。

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    尊敬的 Kengo-San:

    1/2。 加电时、VREF 可偏置为0V 以外的电压;但是、它绝不应超过 AVDD。

    加电后、我们没有针对 CLK 的特定时序。 电源稳定后、系统 CLK 可应用于器件。

    谢谢

    -TC