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[参考译文] DAC5674:输出 DAC

Guru**** 2553260 points
Other Parts Discussed in Thread: DAC5674

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1000754/dac5674-output-dac

器件型号:DAC5674

你(们)好

我已经使用 DAC5674尝试了一些情形

为 DAC 提供的外部时钟为100MHz,需要获得30MHz 的输出。 我也在 DDS 编译器中给出了相同的结果。 但输出仅为10MHz。

2. 提供给 DAC 的外部时钟为200MHz,需要获得30MHz 的输出。 我也在 DDS 编译器中给出了相同的结果。 但输出仅为20MHz。

3. 提供给 DAC 的外部时钟为 180MHz,需要获得30MHz 的输出。 我也在 DDS 编译器中给出了相同的结果。 但输出仅为15MHZ。

为 DAC 提供的外部时钟为 400MHz,需要获得30MHz 的输出。 我也在 DDS 编译器中给出了相同的结果。 但输出为30MHz。

我们无法理解这种情况、请建议我们解决此问题。

谢谢

Roja V

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    您好、Roja、

    您是否正在使用自己的电路板设计、或者 TI 的评估板是否存在问题?

    请提供建议。

    此致、

    Rob

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    你(们)好

    我们使用的是自己的设计、但原理图与 TI 相同。

    请建议我们解决此问题。

    谢谢

    Roja V

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    Roja、

    DIV0、DIV1、X4、HP1和 HP2有哪些设置? 您是否尝试使用内部 PLL? 进入 DAC 的数据速率是多少? DDS 编译器是什么意思? 如果在外部时钟模式下使用器件、PLLLOCK 引脚上的信号频率是多少? 您能否发送正在创建此30MHz 音调的测试模式文件?

    此致、

    Jim

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    你(们)好

    我们使用的外部时钟模式的频率为200MHz、来自信号发生器。 我们使用 x4配置,因此 DIV0和 DIV1为“XX”、“XX”、HP1和 HP2为0 ,这意味着我们使用低通和低通。

    PLL 锁定为50MHz、我认为 x4配置具有外部时钟模式、因此200/4=50MHz (PLL 锁定)。

    请您能帮我解决这个问题。

    谢谢

    Roja V

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    Roja、

    当 PLLLOCK 为50MHz 时、进入 DAC 的数据速率必须为50MHz 并与该时钟同步。 根据数据表的图27、输入数据必须满足设置和保持时间要求。 您是否使用 PLLLOCK 为数据计时? 当数据速率为50MHz 且使用4倍插值时、您可以实现的最大输出频率为 Fdata * 0.4 = 50MHz * 0.4 = 20MHz。 这可能是您的问题。 您无法使用200MHz 时钟获得30MHz 输出。

    此致、

    Jim  

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    你(们)好

    如果我们将 x4模式更改为2x 模式、我们是否可以获得200MHz 至30MHz 的频率。

    我需要以 PLLLOCK 或 DAC 外部时钟为基准向 DAC 发送数据样本。

    请帮助解决问题

    谢谢

    Roja

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    Roja、

    您应该能够使用具有2x 模式的200MHz 时钟获得30MHz 的频率。 您可以使用任一时钟对 DAC 数据样本进行同步采样。 但是、外部时钟必须进行分频、因为它的运行速度比数据速率快2倍。 同样、采样数据必须满足与 PLLLOCK 时钟相关的建立和保持时间。 不过、我强烈建议您为此使用 PLLLOCK。

    此致、

    Jim