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[参考译文] ADC128S102:在单个 SPI 总线上进行并行配置

Guru**** 2455240 points
Other Parts Discussed in Thread: ADC128S102

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/998888/adc128s102-parallel-config-at-a-single-spi-bus

器件型号:ADC128S102

大家好、

你好。

我们的客户在一个 SPI 总线中并行使用两个 ADC128S102 他将 SPI 总线信号连接在一起。 由于 NCS 信号没有专用信号、因此他通过逆变器将这些信号组合在一起。

其中一个 ADC 直接连接到 FPGA 的 CS 信号、另一个 ADC 通过逆变器连接。 因此,ADC 1从 FPGA“高电平”激活,ADC 2从控制 FPGA 的逻辑电平“低电平”激活。

 在从 FPGA 转换 CS 的过程中(低->高和高->低)、两个输出都可以在短时间内(大约 ns)有效。 问题是、这是否会导致 ADC128S102的输出(DOUT)过载?

感谢您的确认。

艺术

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好!  

    如果两个器件都处于活动状态并驱动共享 SDO、则器件肯定会承受应力、并可能损坏。 根据 SDO 线路的状态、可能会通过器件消耗过多的电流。  

    我建议寻找一种方法来确保单个 CS 线路一次处于活动状态、而不会出现任何过渡交叉。  

    此致

    Cynthia

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好!  

    我用一个逻辑器件来描述 您的设置、他们让我知道、如果唯一担心的是两个 CS 信号之间的转换、例如 SN74LVC、那么这应该是可以接受的。 这些器件中的逻辑大约为30ns、速度相当快。  

    请注意、这仅在两个 CS 信号之间的转换期间发生。 器件应同时置为有效并持续较长时间

    此致

    Cynthia