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https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/948932/question-about-adc-f-clk-conversion-time-acquisition-time
您好！
我想知道、如果我更改 f (clk)、 转换时间和采集时间会如何变化？
如果我想 提高系统精度， 它与 f(clk)有关吗？
最好有相关的技术文档。
谢谢！
你(们)好！
要回答您的问题、我们需要知道您使用的器件是什么。 您能否提供器件型号？
我尝试使用 ADS7223、
我想知道如果我更改 f (clk)、 转换时间和采集时间会如何变化？
2.如果我想 提高系统精度， 它与 f (clk)有关吗？
BTY、吞吐率是否等于采样率、单位为？
BR、
对于 ADS7223及其配套器件、f (clk)并不真正控制采集时间。 不过、它确实控制转换时间。 12位器件需要14个时钟周期才能完成其转换周期。 转换完成后、器件会自动返回到采集模式。 在下一次应用 CONVST 输入之前、它将一直保持在采集模式。
为了提高精度、您可以更长时间地保持采集模式(在应用 CONVST 之间有更多的时间)、但会以吞吐量为代价。 例如、在1MSPS 的最快吞吐量和20MHz 的 f (clk)下、最小采集时间为100ns、假设每1uS 应用一次 CONVST。 如果将 f (clk)保持在20MHz、并将 CONVST 应用之间的时间增加100ns、则采集时间增加100ns。 您的吞吐量现在为1.1uS 或909kSPS。
