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我在今年3月至4月运行了一个设置、该设置产生了131.027MHz 的输出频率、现在是138.197MHz、运行相同的设置文件。
下面是我的设置文件...我已验证应用了153.6MHz 的正确输入时钟。
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我在今年3月至4月运行了一个设置、该设置产生了131.027MHz 的输出频率、现在是138.197MHz、运行相同的设置文件。
下面是我的设置文件...我已验证应用了153.6MHz 的正确输入时钟。
CDCE63005无法锁定和输出 DAC3484EVM 卡上的131.072MHz FPGA 时钟输出。 连接到平衡-非平衡变压器的 LMK04828BEVM 的时钟输入为153.6MHz LVPECL20、以生成 J9连接器的单端输入。 无论153.6MHz 输入咔嗒板是否连接,PLL 都不会锁定,输出漂移至138.197MHz。 我在4个月前做过这个工作,但现在 PLL 似乎不会锁定。
CDCE62005无法锁定并输出 DAC3484EVM 卡上的131.072MHz FPGA 时钟输出。 连接到平衡-非平衡变压器的 LMK04828BEVM 的时钟输入为153.6MHz LVPECL20、以生成 J9连接器的单端输入。 无论153.6MHz 输入咔嗒板是否连接,PLL 都不会锁定,输出漂移至138.197MHz。 我在4个月前做过这个工作,但现在 PLL 似乎不会锁定。
今天早上、它加电、加载、输出正确的频率、但 D1锁定 LED 未亮起。 按下唤醒按钮似乎没有效果。 该 PLL 滤波器是否对温度敏感? 下面是通过 DAC3484EVM 软件控制 GUI 进行的 CDCE62005 VCO 设置