[参考译文] ADC12J4000EVM：正常模式下的 ADC12J4000EVM 问题

你好，Dmitri
您能否提供一个芯片示波器或类似的 FPGA 探针来显示在斜坡测试模式和正常 ADC 数据模式下看到的每个通道的八位位组数据？ 请在捕获中包含至少2帧(16个八位位组)的数据。
您的捕获 IP 是否包含实现 JESD204B 标准所需的对齐字符监控和替换的逻辑？ 如果不是，某些帧的末尾会出现意外字符，您的 IP 可能会错误地解释这些字符，从而导致您看到的 rxbyteisaligned 状态错误。
谢谢、
Jim B

Jim、您好！

我使用标准 Xilinx JESD204B 内核(JESD_PHY + JESD_RX 合并在一个内核中)。 因此、字节对齐应在 Xilinx 的 IP 内核内部完成。

GTX_rxbyteisaligned_out 信号是 JESD_PHY 内核的状态标志。

下面是我得到的结果：

I)斜坡测试模式

JESD_PHY 状态信号 gt[0...7]_rxbyteisaligned_out 均为高电平。

JESD IP 内核输出：

4f4e4d4c4f4e4d4c4f4e4d4c4f4e4d4c4f4e4d4c4f4e4d4c4f4e4e4d4f4e4d4d4c4f4e4d4c
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II)正常模式(矢量发生器输出频率= 497MHz、两个功率级别从-23dBm 到-2dBm)

JESD IP 内核输出：
80075970a001e63f80fa84efe0f6705fc0f8babf90ff2f7010067fd090087cf0
078cc0080870c004030650fdfc9ccff7f76c2ff7f79aaffcfd05700304683008
40025490e0078d40b0076290b002fb7f80fb916f10f76aaf50f8ac9f30fe1580
f9c10fff00363006068590080877a005041d70fefdad4ff8f76abff6f78b6ffb
a0f6776f40fad12f000144c0100786a010086ea0500410e0c0fc9eff80f76e3f
fa881ff7f76c2ff8f8b30ffefe1cb004057d9008088260060530e0ffbf5ff9.
1001e2bf50fa800fc0f66f8f60f9bbbf30002ff0600681b0a0087ee0c0041d00

 

DEMAPPER 输出(矢量发生器上的信号电平为-23dBm)：

 

GTX 输出(JESD_PHY IP 内核)上的所有状态信号均为高电平。
某些信号看起来是线 A 正弦。

然后、我将信号功率增加到-2dBm

信号振幅按比例增加：

但是、JESD_PHY (GTX 状态)均为低电平：

 

 

 

提前感谢、

－Dmitri。