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[参考译文] DAC39J84:JESD 通道错误

Guru**** 2609955 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/672272/dac39j84-jesd-lane-errors

器件型号:DAC39J84
主题中讨论的其他器件:TSW14J10EVM

您好!

我在使通道使用此器件时遇到问题。

我正在使用模式 LMFSHD = 4、4、2、1、0、其中 k (每多帧的帧数)= 10、输入时钟为100MHz、无内插、DAC PLL 处于旁路模式。 我的 SYSREF 是2.5MHz。 TRSTB 保持低电平、TXENABLE 保持高电平。

通过测试模式、我已验证 FPGA 是否以2Gbps 的比特率发送 k28.5字符。 在正常运行期间、我可以看到同步丢失、并且正在尝试重新同步。

当我读取警报时、我使 DACPLL 退出锁定状态、Serdes PLL 1退出锁定状态、所有4个通道的通道错误为0x0F03。 当我初始化演示板时、我会得到相同的 PLL 锁定错误、因此我认为这是可以的、因为我绕过了 DACPLL 而不使用 Serdes PLL 1。 我还会注意到、我能够让演示板使用非常相似的设置。 主要区别在于不同的频率和通道交换。

下面是我的初始化序列:

//解除 CLK 分频器和 JESD 链路
0x02、0x2002
0x24、0x0000
0x5C、0x0000

// DAC PLL 设置(禁用)
0x1A、0x0020
0x31、0x1000
0x32、0x0000
0x33、0x0000

//串行器/解串器设置
0x3B、0x0000
0x3C、0x0228
0x3D、0x0088
0x3E、0x0108
0x3F、0x0000

// JESD 设置
0x46、0x0044
0x47、0x190A
0x48、0x31C3
0x49、0x0000
0x4A、0x0F1E
0x5F、0x0123
0x60、0x4567

// JESD 设置
0x03、0xA300
0x25、0x0000
0x4A、0x0F1E
0x4B、0x0901
0x4C、0x0903
0x4D、0x0300
0x4E、0x0F0F
0x4F、0xBCC1
0x50、0x0000
0x51、0x00FF
0x52、0x00FF
0x53、0x0000
0x54、0x00FF
0x55、0x00FF
0x5C、0x1103
0x5F、0x0123
0x60、0x4567
0x61、0x0111

//DSP 设置
0x00、0x0018
0x01、0x0003
0x02、0x2002
0x03、0xA300
0x04、0xF0F0
0x1E、0x9999
0x1f、0x9980
0x20、0x0000

// Arm CLK 分频器
0x24、0x0030
// Arm JESD Link0
0x5C、0x1103
//将 JESD 从复位中拉出
0x4A、0x0F1F
//将 JESD 从初始化状态中拉出
0x4A、0x0F01

请提供任何帮助。

谢谢、

Robbie

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    Robert、

    我们将对此进行研究。 您使用的是什么 FPGA?

    此致、

    Jim

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    您好、Jim、

    我使用的是 Kintex-7。

    谢谢、

    Robbie

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    Robert、

    我让我们的 EVM 根据您的设置运行。 我已连接 LMK 和 DAC 寄存器设置。 这使 DAC 采样频率为100MHz、无内插、4通道、SYSREF = 2.5MHz、K = 10且扰频器被禁用。 我使用 的是 DAC 输入 RX0-RX3、但顺序相反、因为这就是它们在 EVM 上的路由方式。 包含信道 ID 信息的寄存器可能与您的系统不匹配、但所有其他设置都应该匹配。 查看这些寄存器设置与您使用的寄存器设置的比较情况。 如果需要、我们提供了示例 Xilinx 源代码、用于使用 KC705开发板测试 DAC EVM。

    此致、

    Jim

    e2e.ti.com/.../Fs_5F00_100M_5F00_LMF_5F00_4421.cfg 

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    您好、Jim、

    感谢您的观看。 示例 Xilinx 代码将大有帮助。 我想我们要么遇到焊接问题、要么遇到原理图问题、要么是 VHDL 问题、而这个代码可以消除另一个未知问题。

    谢谢、

    Robbie

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    Robert、

    您可以在 TI 网站的 TSW14J10EVM 产品文件夹下找到示例代码。 Xilinx 网站上还有示例代码。

    此致、

    Jim

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    好的、谢谢。
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    您好、Jim、

    我们能够解决通道错误。 事实上、FPGA 中的 JESD 内核不是使用与 DAC 中的 JESD 相同的时钟源计时。 这会导致通道错误、因为两个时钟未锁相。

    现在没有误差、但 DAC 没有输出任何预期的值。 输出约为1V、负载为50 Ω。 我已经尝试将 DAC 设置为输出一个恒定值、但输出不会改变。 您能想到可能发生这种情况的原因吗? 我目前正在再次调查硬件的原理图问题、但可能我在寄存器设置中遗漏了一些内容。 要输出恒定值、我执行以下操作:

    1.初始化时钟
    2.使用正常设置初始化 DAC
    3.将寄存器0x2F 写入0x0005
    4.将寄存器0x02写入0x2000
    5、将寄存器0x30写入任意数字

    谢谢、
    Robbie

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    Robert、

    更好的测试是将 NCO 用作输出音调发生器。 要将 NCO 用作输出、您需要编写以下内容:

    添加0x02    0x2050

    添加了0x2F    0x01

    添加0x14、添加0x15、添加0x16 (这是 DAC 时钟频率和 NCO 频率)

    添加了0x17 0x1140

    添加了0x17 0x1142

    添加0x17 0x1140  (该序列用于同步 NCO)  

    如果您可以获得 NCO 输出、这将验证 DAC 正在正常接收电源、时钟和 SYSREF 以及 SPI 是否正常工作。 TXENABLE 是如何配置的? 这必须为高电平才能使 DAC 提供有效输出。  

    此致、

    Jim

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    您好、Jim、

    我尝试使用 NCO 生成音调、但仍然没有任何效果。 TXENABLE 被拉至高电平、并且 sif_txenable 也被置位。 为了验证 SYSREF 是否正常工作、我从时钟芯片上禁用了它、并验证了我是否遇到了通道错误。 然后我重新启用它、通道错误消失。

    感谢进行音调测试。 我将在确定正在发生的情况后使用它。 我怀疑它与硬件相关。 电源中的电流。

    谢谢、
    Robbie

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    我们最终能够获得输出。 事实上、Rbias 电阻器未放置在电路板上、即使它显示应该放置在原理图上。