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[参考译文] LM98640QML-SP:LM98640

Guru**** 2482225 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1280340/lm98640qml-sp-lm98640

器件型号:LM98640QML-SP

TI_Genius Kirby 说:

"LVDS 输出使用1.8V 驱动器。  该部件的其余部分使用3.3V 电源供电。  VIH 和 VOH 用于 SPI 而不是 LVDS 输出。  请参阅 LVDS 输出表以了解 LVDS 规范。"

Kirby 指出 VIH 和 VOH 电平用于 SPI。  问题在于、表6.6中为 SPI 列出的 VIH 电平对应于3.3V 接口、但表6.6中为 SPI 列出的 VOH 电平对应于1.8V 电平。  那么、Kirby 关于部件其余部分耗尽3.3V 电源的说法是否正确?

我询问 SPI 接口是1.8V 还是3.3V。  列出的 SPI 输入信号电平为3.3V、但列出的 SPI 输出信号电平为1.8V。

请注意、VIH 用于 SPI 输入信号 SCLK、SEN、SDI 和 CLPIN、而 VOH 用于 SPI 输出信号 SDO。

Kirby 或其他人能否说明?

SPI 输入接口是否为3.3V 信令、SPI 输出接口是否为1.8V 信令?  如果是这样、也没问题、但请澄清这是这样的。  最好能在数据表中清楚地说明这一点。

谢谢!

斯科特

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    Scott、您好、  

    我想您在 这里指的是 Kriby 的回应。  正确。 为 SPI 接口使用3.3V 或2.5V 数字信号。  

    我有点不同意 你对 VOH 水平的分析。 所有电源、温度和工艺变化范围内的最小 VOH 以1.8V 的形式给出、典型值为1.93V。 使用1.8V 电源时无法实现这一点。 但我也同意、产品说明书本应更清晰一些。 感谢您的反馈。  

    我还在 这里查看了 LM98640EVM 原理图 、并 在这里查看了相应的 FPGA 采集卡(Wave Vision 5)。 我看到 FPGA 上有一个2.5V I/O 库用于传输 SPI I/O 信号。 您能否遵循同样的方法?  

    谢谢。  

    卡尔蒂克  

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    Karthik、您好、

    感谢您的快速响应。  我明白你在说什么。  我有一个可用于 SPI 接口的3.3V I/O 组。  如果可以接受、我将使用3.3V 信号。  

    它们在绝对最大额定值表中没有清晰列出 SPI 信号。  是否打算说"VDD33引脚"包括由 VDD33供电的引脚?  可以说 SPI 接口信号的绝对最大电平为-0.3min 和 VDD33 +0.3 max、不超过4.2V 吗?

    感谢您的支持、

    斯科特   

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    Karthik、您好、

    感谢您的快速响应。  我明白你在说什么。  我有一个可用于 SPI 接口的3.3V I/O 组。  如果可以接受、我将使用3.3V 信号。  

    它们在绝对最大额定值表中没有清晰列出 SPI 信号。  是否打算说"VDD33引脚"包括由 VDD33供电的引脚?  可以说 SPI 接口信号的绝对最大电平为-0.3min 和 VDD33 +0.3 max、不超过4.2V 吗?

    感谢您的支持、

    斯科特   

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    Karthik、您好、

    另外、您能否告诉我、SPI 信号是否具有类似于"模拟信号"的二极管保护?  第6.6节中的注1显示了"模拟信号"上连接到 VA 和 AGND 的二极管保护。  VA 是否与 VDD33相同、AGND 是否与 VSS33相同?  SPI 信号是否具有这种相同的保护?  是否所有信号都具有此保护?

    感谢您的支持、

    斯科特

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    Scott、您好、  

    对于您的 VOH 3.3V I/O 组输出线路(SCLK、SEN、SDI、CLPIN)、您是否能够确保 FPGA >2V 且 VOL <0.8V? 而对于输入线路(SDO)、您能确保 VIH<1.8V 且 VIL>0.2V。 然后、我看不到接口有任何问题。  

    "是否打算说"VDD33引脚"包含由 VDD33供电的引脚? 可以说 SPI 接口信号的绝对最大电平为-0.3min 和 VDD33 +0.3 max、不超过4.2V 吗?" -是的,这是正确的。

    是的、SPI 线路具有二极管保护、如数据表第6.6节的注释1所示。

    谢谢。
    卡尔蒂克

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    Karthik、您好、

    由于 SDO 信号由3.3V 逻辑驱动、您是否同意所选的 FPGA 输入的绝对最大电压规格应大于3.3V?

    感谢您的支持、

    斯科特   

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    Scott、您好、  

    是的、这种说法 是公平的(3.3V 或更高)。  

    谢谢。  

    卡尔蒂克