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[参考译文] ADS127L11:更大限度减少用于控制 ADS127L11和电源主题的信号

Guru**** 1456330 points
Other Parts Discussed in Thread: ADS127L11, ADS1278, ADS127L01
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1350456/ads127l11-minimize-signals-to-control-an-ads127l11-and-supply-topics

器件型号:ADS127L11
主题中讨论的其他器件: ADS1278ADS127L01

您好!

我将在我的设计中驱动多个并联且完全同步的 ADS127L11。 每个 ADS127L11都将有自己的隔离电源、并将通过数字隔离器与 SoC 进行通信。 因此、我希望尽量减少能够驱动 ADS127L11的信号。 我正在考虑以下问题:

- RESET :不会被使用,并通过一个上拉电阻连接到5V 电源。

- DRDY:将不使用,而 SDO/DRDY 将用于其双重功能。

- CS:将不使用,因此默认情况下应启用3引脚 SPI。

- CLK 和 SCLK:是否有办法将它们联系在一起进行一对一的关系并跳过一个信号? (我过去在 Framesync com 中使用 ADS1278成功完成了这一要求。 模式)。

是否有其他建议尽可能减少隔离栅上的信号数量?

此外、我打算将与 AVDD 相同的5V 电源用作 IOVDD。 如果模拟和数字电源的电源路径彼此之间分离得很好、您觉得这有什么问题吗?

谢谢、此致、

哈维尔

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    Javier、您好!

    您至少需要 CLK、SCLK、SDO 和 SDI。  需要 SDI 来配置和同步 ADC。  当使用3线 SPI 模式时、CLK 必须是连续的、ADC 会计算精确的 SCLK 数量以确定帧长度。

    由于您要对每个 ADC 进行隔离、因此我假设您的系统中可能有相当大的噪声。  尽管始终可以通过发送 SPI 复位模式来复位 SPI (图8-23)、但您可能需要考虑使用/CS、因为这可以提供更可靠的接口。

    此外、如果您计划使用低延迟同步滤波器、则可以为每次转换使用 START/STOP 命令。  这将为每个读数重新同步每个 ADC。  这种方法要求数字滤波器对每个转换结果完全稳定、从而将最大转换速率限制在大约100ksps。  这种方法的优点是、它允许为每个 ADC 使用一个本机振荡器(或内部振荡器)、而不是每个 ADC 使用一个通用时钟振荡器和隔离通道。  这将不提供 ADC 之间的确切时序、但在此用例中、您将处于一个时钟振荡器周期内。  使用此方法、25.6MHz 的内部 ADC 振荡器将适合 测量低频(高达50/60Hz)输入信号。

    是的、您可以为 AVDD 和 IOVDD 使用通用5V 电源、但您将需要尽可能过滤 AVDD 电源、以减少数字噪声耦合到模拟输入读数中。  无论是无源滤波器(RC +铁氧体)还是性能更佳的滤波器、请使用稍高的5.3V 电源和低噪声、高 PSRR LDO 来生成 AVDD 5V 电压。

    此致、
    N·基思
    精密 ADC 应用

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    谢谢 Keith、我会听从您的建议。 令人遗憾的是、这些器件不支持 Framesync、因为对 CLK 和 SCLK 使用单个时钟信号非常实用。

    此致、

    哈维尔

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    Javier、您好!

    您可能需要查看 ADS127L01。  此器件具有类似的性能、并支持帧同步接口。  模拟和数字电源电压均限制为3.6V、但除此之外、具有相似的噪声性能。

    此致、
    基思

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    谢谢 Keith、我会在下一次硬件迭代中对其进行评估。

    此致、

    哈维尔

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    Javier、您好!

    感谢您的反馈。

    此致、

    基思