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[参考译文] ADC12QJ1600EVM：评估板和参考 FPGA 设计

admin
Guru**** 1955920 points
Other Parts Discussed in Thread: TSW14J57EVM, ADC12QJ1600EVM, TSW14J59EVM
请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/data-converters-group/data-converters/f/data-converters-forum/1435199/adc12qj1600evm-evaluation-board-and-reference-fpga-designs

器件型号：ADC12QJ1600EVM
主题中讨论的其他器件： TSW14J59EVM、TSW14J57EVM

工具与软件：

您好！

我开始 使用 ADC12QJ1600EVM、并且我有几个问题：

  1. ADC12QJ1600EVM 用户指南指出、推荐用于连接该夹层的 FPGA 载板是 TSW14J57EVM。 但是、在 ADC12QJ1600EVM 网站上、建议的载板为 TSW14J59EVM。 哪一个是正确的载板？ 都适用吗？
  2. 是否有适用于 Vivado (TSW14J59EVM)/Quartus (TSW14J57EVM)的 FPGA 参考设计作为 FPGA 定制设计连接 ADC12QJ1600EVM 的起点？

提前感谢您！

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    TI__Guru**** 1955920 points
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    您好、Sergio、

    推荐的板是 TSW14J59 EVM、TSW14J57已停产。  

    就参考设计而言、目前我们仅支持 Xilinx 类 FPGA、目前无法支持 Intel 和 Quartus。

    此致！

    Eric

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    TI__Guru**** 1955920 points
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    Eric、您好！

    感谢您的回答。

    我在哪里可以找到您提到的 Xilinx FPGA 参考设计？

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    TI__Guru**** 1955920 points
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    您好、Sergio、

    该设计是应要求完成的、因为这些设计适用于 ADC 器件、ADC 工作模式、ADC 采样频率和 FPGA。 申请设计的第一步是提交 TI JESD IP https://www.ti.com/tool/TI-JESD204-IP 申请

    此致！

    Eric  

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