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器件型号：ADC3910D125 工具与软件：
在 ADC3910D125EVM 原理图第4页上、有一个将 SEN/M0、SCLK/M1和 SDIO/M2 (以及 OEN 线)下拉的引脚控制电路。 还有 J5接头 、或许可以使用该选项将这些线路中的任何一条拉高？ 用户指南除了保持 J5跳线未安装外、评估板未提及这一点。 M0..M2名称和下拉菜单意味着硬件复位或上电时可能存在某种模式配置。
ADC3910D125数据表未提及 M0..M2模式引脚。 它只有 SEN、SCLK 和 SDIO。 它们有内部下拉电阻。
那么这些引脚在硬件复位期间保持低电平(或不由我们的 SPI 电路驱动、以便下拉电阻可以正常工作)是否很重要呢？ 它们是否具有数据表中未记录的引导配置用途？
