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器件型号：DLPC3436 如果我们理解正确、则 AP 需要两个 LVDS 端口连接到 FPGA 以驱动1080p。 原因是标准 LVDS 接口支持85Mhz 时钟(如果我理解正确)。
但是、我们可能选择使用的 AP 仅支持一个 LVDS 端口(具有148.5MHz 时钟)。
如果 FPGA 能够支持具有更高时钟频率(148.5MHz)的单个 LVDS、我就会漂移。
如果不是、如何选择替代解决方案？ 使用1到2桥？ 或者我们可能必须使用 RGB 接口、这种接口的无干扰性更低。
