[参考译文] DP83867IR：IBIS 模型验证

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Other Parts Discussed in Thread: AM6442, TMDS64EVM

请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/1561981/dp83867ir-ibis-model-verification

器件型号：DP83867IR
主题中讨论的其他器件：AM6442、 DP83869、 TMDS64EVM

工具/软件：

您好、

在 DP83867IRRGZT 的 IBIS 模型中、引脚 15 (X_I) 标记为 NC 、但仿真向导将 VIH 显示为 2V、VIL 显示为 800mV、 这与 我使用的 1.8V 逻辑电平不匹配。 AM6442 处理器也会出现同样的问题、其中引脚 C21 在 IBIS 模型中也标记为 NC。我使用了您网站上的最新 IBIS 模型、更改 Vih/Vil 值似乎会影响仿真中的下冲/过冲。您能澄清一下吗？我将提供快照供您参考。

3 个月前

0 admin 3 个月前

TI__Guru**** 2538955 points

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您好、

对于 DP83867、请专门为该引脚使用 DP83869 IBIS 模型。 DP83869 IBIS 与此引脚上的 DP83867 IBIS 相关。
我会将有关 AM6442 的问题推迟到 Sitara 团队讨论。

此致、
j

0 admin 3 个月前

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您好 Fhthima、

您能否确认您是否计划使用晶体+不孕振荡器。

对于内部振荡器、振荡器为内部振荡器、您需要根据数据表选择晶体和无源器件。

我不确定是否需要模拟习近平。

您能详细说明一下这个用例吗？

此致、

Sreenivasa.

0 admin 3 个月前

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尊敬的 J：

对于 DP83867、请专门为该引脚使用 DP83869 IBIS 模型。 DP83869 IBIS 与此引脚上的 DP83867 IBIS 相关。
我会将有关 AM6442 的问题推迟到 Sitara 团队讨论。 [/报价]
对于 DP83867、时钟输入是固定的 1.8V 输入、不随 IO 缩放。

Xi 是否仍与 DP83869 兼容？

此致、

Sreenivasa.

0 admin 3 个月前

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您好 Fhthima、

NC 是 AM64x 系列处理器的预期连接。这是晶体或振荡器输入。我们不会为处理器的时钟部分 IP 提供任何 IBIS 模型。

此致、

Sreenivasa.

0 admin 3 个月前

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您好 Sreenivasa、

869 中的 XI 引脚通过三个输入电压 (1.8V、2.5V 和 3.3V) 进行缩放、与 867 兼容。

此致、
j

0 admin 3 个月前

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您好 J

谢谢你。

此致、

Sreenivasa.

0 admin 3 个月前

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您好、

我们正在参考 TMDS64EVM 设计一个定制电路板。在 EVM 中、AM6442 处理器从时钟缓冲器接收引脚 C21 处的时钟输入。我正在对 EVM 执行 SI 分析后、在分析时钟引脚时发现了一个问题。您能否解释一下为什么在 IBIS 模型中将 XI 引脚标记为 NC？

此致、

Fhanitha M

0 admin 3 个月前

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您好 Fhthima、

您能解释为什么 XI 引脚在 IBIS 模型中标记为 NC 吗？

NC 是 AM64x 系列处理器的预期连接。这是晶体或振荡器输入。我们不会为处理器的时钟部分 IP 提供任何 IBIS 模型。

我没有额外输入。如果您知道 ANT SOC 具有适用于 Xi 的 IBIS 模型、请查尔。这是标准方法。

在 EVM 中、AM6442 处理器从时钟缓冲器在引脚 C21 处接收时钟输入。我正在对 EVM 执行 SI 分析后、在分析时钟引脚时发现了一个问题。 [/报价]
请添加有关该问题的详细信息

此致、

Sreenivasa.

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