[参考译文] TS3DV642：TS3DV642上的HPD信号电平电压容差？

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https://e2e.ti.com/support/interface-group/interface/f/interface-forum/583238/ts3dv642-hpd-signal-level-voltage-tolerance-on-ts3dv642

部件号：TS3DV642

大家好，

客户将TS3DV642用于HDMI和eDP交换机，附件是客户示意图，您能否帮助查看此示意图以了解是否存在任何问题？

另一方面，如果连接器侧为5V，客户想知道设备侧的HPD电压范围或容差是多少？ TS3DV642是否需要任何拉高电阻器或拉低电阻器来接收来自连接器侧的HDMI和eDP信号？请提供建议。谢谢。

此致，

亚瑟

e2e.ti.com/.../MEDM_2D00_C603_5F00_ZR0_5F00_2017.0322万.pdf

8 年多前

0 admin 8 年多前

TI__Guru**** 2470720 points

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亚瑟

感谢您的发布。我已联系负责此设备的工程团队，他们很快就会与您联系。

谢谢！
亚当

0 admin 8 年多前

TI__Guru**** 2470720 points

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您好，Arthur：

HPD可以处理5V；在GPU/CPU上放置100k下拉列表，以在没有连接显示器时禁用它。
DDC需要上拉，这些上拉是靠近GPU/CPU还是接头？

此致

0 admin 8 年多前

TI__Guru**** 2470720 points

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您好，Adam：

是的，CPU板有100k下拉式。此外，DDC在I/O板上具有较高的拉力。

还有一些问题，对于eDP (或DP)应用程序，HPD处于低活动状态，它是否需要额外的拉高？还是只需保持相同，以便在连接器侧下拉100k？然后将HPD_A，HPD_B连接到CPU，GPU？

对于SEL1，SEL2信号，是否可以使用GPIO来控制其H或L，而不是使用硬件来进行修复？

请提供建议。谢谢。

此致，
亚瑟

0 admin 8 年多前

TI__Guru**** 2470720 points

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大家好，

请帮助客户对以下问题进行评论。谢谢。

对于eDP (或DP)应用，HPD处于低活动状态，是否需要额外的高拉力？还是只需保持相同，以便在连接器侧下拉100k？然后将HPD_A，HPD_B连接到CPU，GPU？

对于SEL1，SEL2信号，是否可以使用GPIO来控制其H或L，而不是使用硬件来进行修复？

此致，

亚瑟

0 admin 8 年多前

TI__Guru**** 2470720 points

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您好，Arthur：

如果GPU的HPD处于活动低电平状态，则您需要使用逆变器，显示屏将提供HPD=HIGH。
HDMI HPD为5V
DP HPD为3.3V

是的，SEL信号可由uController驱动。

此致

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