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[参考译文] DS90UB953-Q1：DS90UB954-Q1，从CSI输入到dout和dout输入到CSI输出之间的延迟

admin
Guru**** 2465890 points


请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/637278/ds90ub953-q1-ds90ub954-q1-latency-between-csi-input-to-dout-and-dout-input-to-csi-output

部件号：DS90UB953-Q1

您好，

请您告诉我时间安排表，其中包括以下时间安排？

953 CSI输入至DOUT+/-输出
954 DIN+/-输入至CSI输出

PDB HIGH (PDB高)之间是否有输入有效CSI数据的时间要求？

感谢您帮助此帖子。

此致，
柳枝

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    TI__Guru**** 2465890 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    您好，
    我们已收到您的查询，正在调查最佳回复方式。 CSI－2是基于数据包的，它在时间上可能会有所不同。

    由于链路参考的是反向通道频率REF_CLK或外部CLK_In，因此对于PDB HIGH至何时必须存在有效的CSI－2数据没有限制
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    TI__Guru**** 2465890 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    延迟在很大程度上取决于正在处理的CSI－2数据包类型和行大小，以及CSI－2输入频率和CSI－2输出频率。 我们没有您请求的特定计时，但对于典型的953-954 (以4 Gbps，800Mbps /通道输入和1600 Mbps /通道输出运行)，1280像素线大小的大约延迟为20us (从953 CSI输入到954 CSI输出)。 通过配置954以将FV/LV转换为GPIO，并将其与CSI-2信号上的LP/HS转换进行比较，您可以很好地估计特定系统的延迟。