[参考译文] DP83867IS：phy 的 SGMII 时钟行为。

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器件型号：DP83867IS

在数据表(第5页-引脚功能)上，引脚33 -“SGMII CoP”声明为“由 PHY 驱动”

而其差分对-引脚34 -"SGMII CON"被声明为"由 MAC 驱动"。

这两个引脚都被称为"输出"

我的第一个问题是 SGMII 时钟的方向是什么？ I/O？

如果答案是输出-为了生成这个时钟输出，应该有什么条件(配置)-(自举配置是否足够？或者必须通过 SMI 配置来完成？)

关于两个额外的输入引脚(27、28) SGMII_SIP/N -它们被规定为与差分 SGMII 时钟输入同步-这与 SGMII_COP/N 的定义相矛盾，后者被称为“输出”。

0 admin 4 年多前

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感谢您的查询和输入。感谢您的意见。

关于引脚33/34、输入被记录并且将在下一个修订版本中进行所需的更新。

表56. SGMII 控制寄存器1 (SGMICTL1)、地址0x00D3

1 = 6线制模式。启用到 MAC 的差分 SGMII 时钟。

关于引脚27、28、让我在内部进行检查。

此致、

Sreenivasa

0 admin 4 年多前

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我有以下更新。

在4线和6线模式下、SGMII 接口在内部从在 SGMII_SIP/N 上接收到的数据恢复时钟 PHY 没有差动 SGMII 时钟输入，因此 SIP/N 上的数据应与 MAC 的时钟同步。

我们将在下一个数据表版本中对此进行更新。

此致、

Sreenivasa

接口（参考译文帖）(Read Only)