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[参考译文] DP83869HM:为 CLK_OUT 选择不同的值

Guru**** 2538930 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/1054287/dp83869hm-selecting-different-values-for-clk_out

器件型号:DP83869HM
主题中讨论的其他器件:DP83869

我们将在 MII 回送模式下使用 DP83869。  无论 CLK_O_SEL 值写入 IO_MUX_CFG 寄存器(地址= 0x170)、我们都可以在 CLK_OUT 上看到25MHz 时钟。  我在这个支持论坛中看到了两个不同的线程、在这个论坛中、建议写入寄存器0x00C6。  根据 DP83869的数据表、该寄存器不存在。  我在 DP83867数据表中确实看到 了 PLL 时钟输出控制寄存器(PLLCTL)。   DP83869中是否也存在寄存器?

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/894177/dp83869hm-is-clk_out-capable-of-generating-125mhz-from-internal-pll

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    尊敬的 Ron:

    这些寄存器值是正确的。 要获得125MHz 时钟基准、请将0xD10写入寄存器0x170、将0x10写入寄存器0xC6。

    此致、

    Gerome

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    谢谢。  为什么 DP83869的数据表中没有记录寄存器0xC6?   是否有更新的数据表?  

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    尊敬的 Ron:

    网上提供的当前数据表是最新版本。

    此致、

    Gerome