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器件型号：TIC10024-Q1 你(们)好
逻辑电气 VDD 的关断是否会影响 INT 中断
2.可以在低功耗下关闭 VDD
3.当配置为轮询模式时，输入中断被打开，INT 将始终为低电平，导致这种现象的原因是什么？
4.你能提供例行程序
谢谢！
你(们)好
逻辑电气 VDD 的关断是否会影响 INT 中断
2.可以在低功耗下关闭 VDD
3.当配置为轮询模式时，输入中断被打开，INT 将始终为低电平，导致这种现象的原因是什么？
4.你能提供例行程序
谢谢！
Neal、您好！
我有
逻辑电气 VDD 的关断是否会影响 INT 中断
INT 引脚是一种开漏架构、需要使用一个外部上拉电阻器来实现逻辑高电平。 VDD 逻辑电源用于设置连接到 MCU 的 SPI 信号的逻辑电平、也可用于 INT 上拉电阻器。 但是、如果在 VDD 被禁用时需要激活 INT 引脚、也可以将其连接到12V 电源。 数据表中称为微控制器唤醒的第8.3.9.3节介绍了如何实现这一点、而 TIC10024-Q1数据表中的图15显示了电路。
如果只有一个上拉电阻器连接到 VDD 并且 VDD 电源关断、则不会向 MCU 指示 INT 信号。
2.可以在低功耗下关闭 VDD
是的、如果 SPI 和 INT 用于上拉电源、则 VDD 仅设置其逻辑电平。 该器件完全由 Vs 电源供电、并将保留配置设置。 然而、为了实现正确的 SPI 通信、VDD 必须存在、但是当不需要 SPI 通信时、它可被关闭。 INT 将需要 VDD 电源、除非已按照数据表中所述将其配置为与电源间的上拉电阻。
3.当配置为轮询模式时，输入中断被打开，INT 将始终为低电平，导致这种现象的原因是什么？
我不确定我对您的问题的理解是否正确、但我认为您是指以下行为。
触发位设置为1后、器件将轮询输入并将默认开关状态值存储到存储器中。 完成此操作后、它将设置 INT_STAT 寄存器中的 SSC 位并将 INT 引脚设置为低电平、以指示器件现在正在主动监测输入开关的默认状态变化。 要清除 INT 引脚、MCU 必须读取 INT_STAT 寄存器(偏移= 2h)以清除 SSC 位、进而将 INT 引脚从低电平状态释放。
如果这不是您提到的内容、请指向文档、或提供一些有关配置和尝试释放 INT 引脚的其他信息、这些信息不成功、可帮助我理解。
4.你能提供例行程序
我可以帮助提供例行程序或一些配置建议。 但我不确定您具体要问什么。 您是否只想了解有关如何释放 INT 引脚的信息？ 如果是这样、您只需读取 INT_STAT 寄存器即可。
此致、
Jonathan
你(们)好
Q1是对的？PNP MOSFET？Q1，不是发射器连接到 VIN？、感谢！
Neal、您好！
Q1是 PNP BJT 晶体管、数据表中的图是正确的、但您的建议也适用。
以下是数据表中显示的电路仿真、其中发射极使用方波信号连接到 LDO_EN、以表示 nINT 引脚的输出。
这里是集电极连接到 LDO_EN 时建议的配置的仿真。
您可以看到、这两种配置都应该正常工作、我使用试验电路板对该电路进行了快速原型设计、以验证这两种配置实际上都可以正常工作、如仿真中所示。
有关 如何配置器件的信息、请阅读配置 TIC12400-Q1多开关检测接口(MSDI)应用报告的步骤。 我没有关于您所需配置的任何信息、涉及您要使用的输入、您是要拉电流还是灌电流、 以及您将需要多少电流、您是将使用比较器还是 ADC 进行采样、以及您将需要哪些阈值用于开关类型等
应用报告将引导您完成配置步骤、但如果您对任何详细信息有任何其他问题、请告诉我。
此致、
Jonathan
