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[参考译文] DP83848K：DP83848K

admin
Guru**** 2769425 points
请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/744522/dp83848k-dp83848k

器件型号：DP83848K

您好、先生：

 如下图所示，如果 变压器中心抽头使其变为 NC，将对功能产生什么影响？

谢谢

戈登

  • 0
    TI__Guru**** 2769425 points
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    您好、Gorden、

    需要向上拉中心抽头、否则会发现未知的影响。

    EMI/EMC 辐射可能非常高。 通过不将中心抽头保持在已知的电势、抗扰度可能非常低。

    磁性元件的压降也可能会影响器件的接收器。

    此致、
  • 0
    TI__Guru**** 2769425 points
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     尊敬的 Rob：

     感谢快速回复。

    另 一个问题如下：

    如下面的方框图 图1所示，   带有变压器中心抽头+3.3V_IO 的 DP83848 +3.3V 来自不同的电源。

    电源序列+3.3V_IO  超前+3.3V 24.2ms (图2)，我的问题：它是否可能损坏 PHY，如果 是，为什么？

     

    谢谢

    戈登

    图1：

    图2：

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    TI__Guru**** 2769425 points
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    大家好、Gordon、

    当 AVDD = 0V 时、它可能会损坏 PHY、因为您要向 TD/RD 引脚施加高电压。

    DP83848器件的绝对最大值为 VCC + 0.5V。 在这种情况下、VCC = 0、对 TD/RD 施加3.3V 电压。

    保护 TD/RD 的 ESD 二极管将偏置并导通。 它们会随着时间的推移而降级。 在此事件期间、DP83848也将反向供电。

    此致、
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    TI__Guru**** 2769425 points
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    尊敬的 Rob：

     感谢您的回复：

    如果 在+3.3VD 之后的可调节+3.3V_IO 加电时间低于波形、这是可以的？

  • 0
    TI__Guru**** 2769425 points
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    您好、Gorden、

    是的、可以将+3.3V_IO 电源轨连接到+3.3VD 之后的中心抽头斜升

    此致、
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    TI__Guru**** 2769425 points
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    尊敬的 Rob：
    非常感谢您的回复

    谢谢
    戈登