This thread has been locked.

If you have a related question, please click the "Ask a related question" button in the top right corner. The newly created question will be automatically linked to this question.

[参考译文] DS90UB960-Q1:REFCLK 引脚#39;s 电压逻辑电平

Guru**** 1138100 points
Other Parts Discussed in Thread: TIDA-01323
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/935334/ds90ub960-q1-refclk-pin-s-voltage-logic-level

器件型号:DS90UB960-Q1
主题中讨论的其他器件:TIDA-01323

您好!

    我对 REFCLK 引脚的电压电平有一些疑问。

 (1)在 DS90UB960 EVM 参考设计中、使用具有1.8V 电源的25MHz XO 为 REFCLK 引脚供电、DS90UB960的 VDDIO 为3.3V。

 (2)在 DS90UB960数据表中、REFCLK PI 的最大振幅受 VDDIO 限制。

  

   我的问题如下:

(1) REFCLK 引脚的电源域是什么? VDDIO?

(2)是否最好使用具有 VDDIO 电源的25MHz XO?

对于 XO 输出为 VDDIO 电压逻辑电平、REFCLK 输入也为 VDDIO 逻辑电平、占空比几乎相同。

如果25MHz XO 由1.8V 电压供电、REFCLK 为3.3V LVCMOS 电平输入、这可能会对 REFCLK 引脚看到的占空比产生一些额外的偏差?

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好!

    960EVM 上的 REFCLK 连接到 VDDIO 电源。

    960仅支持将振荡器用作 REFCLK。

    最棒的

    Jiashow

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好!

      感谢你的帮助。

      (1)很抱歉、我犯了一个错误。我参考的设计是 tidrtr6.pdf (文档编号:TIDA-01323 REV:E1.0)

      (2) 在960上仅支持将振荡器用作 REFCLK。

    我计划使用 应用处理器的 MIPI CSI 单元的时钟输出来为 REFCLK 引脚供电、而不是25MHz XO。 没关系吗?

     

      (3)我使用的关键检查点见表3 (列为可选项目除外)。 我还应该考虑其他方面吗?

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    大家好、Merlyn、

    960中的 REFCLK 规格规定振幅可介于800mVpp 和 VDDIO mVpp 之间。

    应该可以、但您需要确保它符合数据表中的 REFCLK 振荡器规格。

    最棒的

    Jiashow

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    谢谢。