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器件型号:DP83825I 团队、
如"图1. 加电时序"、先显示 VVDDIO、然后是 VAVDD 的时序要求。 但第9章说、如果使用 RST_N、则无需排序。
这令人困惑、因为时序图无论如何显示 RESET_N 在上电期间应处于低电平。
您能解释一下吗? 在我的用例中 、VVDDIO 为1.8 V
谢谢。
罗伯特
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团队、
如"图1. 加电时序"、先显示 VVDDIO、然后是 VAVDD 的时序要求。 但第9章说、如果使用 RST_N、则无需排序。
这令人困惑、因为时序图无论如何显示 RESET_N 在上电期间应处于低电平。
您能解释一下吗? 在我的用例中 、VVDDIO 为1.8 V
谢谢。
罗伯特