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[参考译文] DS250DF810:DS250DF810 VOD 处于原始模式

Guru**** 2382120 points
Other Parts Discussed in Thread: DS250DF810, DS250DF230, TDP2004
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/1406184/ds250df810-ds250df810-vod-in-raw-mode

器件型号:DS250DF810
主题中讨论的其他器件: DS250DF230TDP2004

工具与软件:

您好!

TX 端 VOD 在原始模式下的值是多少。 是仅由 RX 的 CTLE/VGA 定义、还是 它是恒定的并由其他一些寄存器定义。 也许这些信息在数据表中、但我对模拟模块的相关信息不太了解 。

此致、

Maksim

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    尊敬的 Maksim:

    在 RAW 模式下、无法很直接地控制 TX VOD。  我相信信号会经过限制阶段、因此我不会期望 VGA 会产生巨大影响。

    在原始模式下、我看到了大约600-700mVppd 的 TX 振幅。

    下面是我在过去拍摄的原始模式的眼图捕捉。

    6.75英寸 ISI 电路板布线:12.89GHz 下插入损耗为6dB

    谢谢!

    Drew

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    你好、Drew。


    我的主要问题可能很愚蠢、但我没有发现 RAW 模式的任何特征输出通道(VOD):TX-VOP 值是否是 RAW 模式下的常量? 现在我看到的是、当将输入端的至少电压摆幅从600mV 更改为1000mV 时、我看不到输出端的电压摆幅变化。 所以、输出上的 VOD 似乎是原始模式下的常数、或者 它肯定是输入的功能、而且我没有正确配置原始模式?

    此致、

    Maksim

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    尊敬的 Maksim:

    您的主要问题并非愚蠢;感谢您澄清您的问题并分享您的观察结果。  由于 DS250DF810处于原始模式下有一个限制级、因此我们预计输入摆幅不会对输出摆幅产生影响、因为输出摆幅将被"限制"至最大值。  换言之、原始模式是非线性信号链。

    DS250DF810没有 直接控制原始模式 VOD 的设置。  请查看我们的25G 重定时器编程指南(SNLU182)、这里有一节介绍调整原始 VOD 摆幅、但重点介绍了 DS250DF230。  DS250DF810没有 DS250DF230上的 raW_TX_swing 控制位(ch_reg_0x0D[0])。

    您可以尝试调整 RPH 寄存器(ch_reg_0x1A[7:6])。  默认值为1。  RPH 寄存器影响整个器件的偏置电流。  您可以尝试将其设置为2或3、然后查看这是否会增加原始摆幅。  请注意、这预计会增加器件功耗。

    谢谢!

    Drew

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    您好、Dreq。

    谢谢你。 我曾尝试使用 RPH 寄存器(ch_reg_0x1A[7:6])、可能会略微更改 VOD。 但这不是我们想要的。 看来这个芯片并不适合我们、因为我们当时是想用它来兼容 Display Port 2.1、采购自 FPGA。

    因此、更直接的问题:

    1. 您是否能够确认 VOD 在原始模式下是恒定的、并且它不依赖于输入信号(如果检测到输入信号)?
    2. DS250DF810是否支持 Display Port 2.1频率(1.62、2.7、5.4、8.1、10、 13.5、20)是否显示在重定时器模式下?

         根据数据表的表5、数据不是5.4除外、但我只是想以防万一。

    1. 我已尝试使用 UG 7.7.1章节中的步骤将 CDR 锁定为5.4Gbit、但运气不好。 我该怎么做? 对我来说、5.4只是芯片应支持的比特率。
    2. 可能无法与当前的芯片连接。 对于兼容 DP 2.1的替换候选芯片、您建议使用哪种芯片。 重定时器是可取的,但 redirriver 也是好的。

    此致、

    Maksim

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    您好、Maksim

    由于美国劳动节假期、您的问题可能会延迟回复。 我们 将在明天( 9月3日)返回时了解您的问题。 对于等待和可能造成的任何不便、我们深表歉意。

    谢谢!

    David

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    尊敬的 Maksim:

    1.由于采用高增益限制放大器、DS250DF810 VOD 在原始模式下基本保持恒定。

    2. DS250DF810支持锁定表5中的速率。  它无法锁定到您列出的所有速率。

    3.我希望器件在重定时模式下支持5.4Gbps、10Gbps 和20Gbps 的速率。  第7.7.1节是参考的正确部分。  需要注意的几个方面:

    • 我认为编程指南中存在差距。  请注意、根据数据速率是小于还是大于13.9Gbps、有两个公式。  但是、这些公式只是根据数据是 div 1还是 div 2进行缩放。  对于5.4 Gbps、该值为 div 4。  请尝试使用全速率公式和全速率(5.4*4Gbps)。
      • 0x60 = 0x00
      • 0x61 = 0xB6
      • 0x18[6:4]= 2
    • 另外、我不太熟悉 DP、但我想知道是否有任何自动协商。  如果有自动协商、您的5.4 Gbps 源是否可能在不首先处理自动协商的情况下发送5.4 Gbps?

    4. TI 拥有 TDP2004转接驱动器。  由于这是特定于 DP 的、因此我希望它能更好地工作。

    另外、我记得 HDMI/DP 可能有一些特定的直流耦合要求。  在选择 DS250DF810时、您是否考虑过这一点?

    谢谢!

    Drew

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    Maksim

    DS250DF810不是专用的 DP 重定时器、其 TX VOD 和预加重功能可能不符合 DP 规范。

    TDP2004是一款线性转接驱动器。 如果您有符合 DP 的源并且其 TX 输出处于 TDP2004线性范围内、则 TDP2004将准确地在其 TX 输出端重新生成该输出。

    谢谢

    David

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    您好!

    谢谢你。 我可以将 CDR 锁定为5.4 Gbit(div=4, 4*5.4Gbits)、2.7 (div=8, 8*2.7Gbits)甚至是1.62(div=16, 16*1.62Gbits)。 但发生8.1G、10G、13.5G、20G 的可能性不大、因为我理解、使用任何受支持的分频器(1、2、4、8、16)时、这些频率不适合20.2752 - 25.8范围。 或者、可能有没有文档记载的定义 div=3的可能性、不是吗? 是否还有更改 CAL_CLK 发生器的可能? 正如我从数据表中了解到的、它必须仅是25MHz、但这是完全不可能的、还是会损坏某些特性?

    抱歉、问的问题、尽管我们应该使用另一个芯片这很容易理解、但我希望通过 DS250DF810实现最大值、可能是信号衰减。 不管怎样、它都会对我们有所帮助。

    关于直流耦合要求:从规格来看、必须有交流耦合、是的、220pF 同样适用于规格

    请将 TPD2004链接发送给您。 您刚才已经确认我想查看此芯片、而且我们已经订购了 EVM。

     

    此致、

    Maksim

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    尊敬的 Maksim:

    很高兴听到您能够以5.4 Gbps 甚至子速率进行传输。  很高兴您了解了 TDP2004。

    不幸的是、没有未记录的除以3的可能性。  对于此器件、支持的速率将是全速率的2^n。

    理论上、可能可以使用不同的 CAL_CLK。  我们的 DS250DF230支持25 MHz 和30.72 MHz。  但请注意、这对器件可以锁定的数据速率没有影响。  CAL_CLK 仅用于大致校准 VCO 频率。  全速率锁定范围受 VCO 较低速率和较高速率的限制。

    谢谢!

    Drew

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    感谢 Drew、David 为您提供了快速且信息丰富的支持。