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[参考译文] SN74AXC4T245：SN74AXC4T245 I/O 内部下拉电阻器的最小值/最大值

admin
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Other Parts Discussed in Thread: SN74AXC4T245
请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/logic-group/logic/f/logic-forum/1487409/sn74axc4t245-min-max-of-internal-pulldown-resister-of-sn74axc4t245-i-os

器件型号：SN74AXC4T245

工具与软件：

您好！

I/O 上集成静态下拉电阻的最大值和最小值是多少？ 我的客户需要将 SN74AXC4T245 I/O 连接到 FPGA I/O。 FPGA IO 在配置期间具有内部上拉电阻器。 我的客户想知道是否满足所需的 VIH。 为此、他们需要知道 SN74AXC4T245 I/O 内部下拉电阻的最小值/最大值。

此致、

K.Hirano

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    您好、Hirano-San、

    内部下拉为62kΩ、变化幅度为±15%。

    此致、

    Josh

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    Josh、

    感谢您的答复。
    但是、让我再确认一下。
    尽管数据表显示它为71KΩ Ω(典型值)、但它是错误的、它是62kΩ(典型值)、对吧？

    此致、

    K.Hirano

  • 0
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    您好、Hirano-San、

    是的。 数据表应列出71kΩ 最大值而不是典型值。 我们将纠正该问题。

    此致、

    Josh