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[参考译文] SN74HCS72:将数据位保持在锁存状态

Guru**** 2343770 points
Other Parts Discussed in Thread: SN74HCS72
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/logic-group/logic/f/logic-forum/1519444/sn74hcs72-holding-a-data-bit-into-latch

器件型号:SN74HCS72

工具/软件:

尊敬的 E2E 团队:

低于要求-

1)  系统存在一个低电平有效错误信号(脉冲:高电平->低电平(100ms)->高电平)输入

2) 根据预定义的规格、可能有单个脉冲或多个脉冲

3)系统要求是有一个用于视觉指示的错误 LED 和错误 LED 应该永久开启在第一个下降沿

4)计划从锁存器驱动错误 LED 使能电路、因为、即使 I/O 引脚上的数据发生变化、锁存器也可以将数据保持在 o/p 处

以下是相关问题:

1)请告知我、上述实现可使用 Weather SN74HCS72?

2)请建议是否有  SN74HCS72以外的合适锁存器 、这可以满足上述要求?

3)是否有其他方式 来 实现上述要求?

此致、

Aditya.

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    您需要使用/PRE/CLR 输入的翻转(如 SN74HCS72)或设置/复位锁存器。 将低电平有效复位信号连接到/CLR、将错误信号连接到/PRE。 CLK 和 D 必须连接到有效逻辑电压、否则无关紧要。

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    您好、

    感谢您的答复。 以下情况下会进行 LT Spice 仿真:

    仿真结果:

    场景1和2:Q ->高电平、Q_N->低电平

    根据"表1.  SN74HCS72数据表 和上面的原理图中的"功能表"、预期结果为:

    场景1和2:Q ->低电平、Q_N->高电平

    仿真结果与预期结果相反。 您在这里有什么想法?

    谢谢、

    Aditya.

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    您的仿真中没有复位信号。 触发器的上电状态未定义。