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[参考译文] SN74LVTH3.2244万：SN74LVTH3.2244万队列

admin
Guru**** 2551110 points


请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/logic-group/logic/f/logic-forum/591974/sn74lvth32244-sn74lvth32244-quesion

部件号：SN74LVTH3.2244万

大家好，

客户想要选择三态输出设备。

要求：1. 32位2. 最小频率为150MHz。 每个通道的电流应大于12mA。 他使用LVTTL电平。

然后推荐 SN74LVTH3.2244万。  

现在，客户有 一个使用 SN74LVTH3.2244万的方框图。 请检查连接。  

如果 像 结构图中一样使用SN74LVTH3.2244万，情况是否正确？

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    TI__Guru**** 2551110 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    您好Mickey：

    您的客户似乎正在使用SN74LVTH3.2244万从D0...DN信号中扇出。 这是一个相当常见的应用程序，应该能够很好地运行。 FPGA应能轻松驱动SN74LVTH3.2244万上的单个输入，这些输入的每个输出都能在下一阶段驱动多个输入(通常高达15个)。

    SN74LVTH3.2244万不直接具有最大频率额定值，但我们可以从采用相同技术创建的另一个设备中推断出来。 SN74LVTH3.2374万是一种基于相同技术(LVT)构建的触发器，具有最大频率额定值(fmax (min)= 160 MHz)。 这意味着SN74LVTH3.2244万肯定能工作到160 MHz，但我无法保证超过160 MHz的工作速度。

    您能告诉我他们想要实现的目标吗？ 我认为他们希望确保在远端进行匹配的定时，这就是为什么他们有两个缓冲级，但负载也将是最终信号定时/质量的一个因素。 所有D0...DN输出上的负载是否相等？

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    TI__Guru**** 2551110 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    Emrys您好，

    感谢您的回复。 我将与客户确认。