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[参考译文] SN74AVC4T245:3.3V 侧时钟信号的压降如下所示(图3)。 您知道原因吗?

Guru**** 2387080 points
Other Parts Discussed in Thread: SN74AVC4T245, SN74AXC4T774, SN74AXC4T245
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/logic-group/logic/f/logic-forum/837546/sn74avc4t245-the-3-3v-side-clk-signal-will-has-a-voltage-drop-as-below-graph-3-do-you-know-why

器件型号:SN74AVC4T245
主题中讨论的其他器件: SN74AXC4T774SN74AXC4T245

大家好、

我的客户 现在正在使用 SN74AVC4T245器件。 VCCA 侧为2.5V、VCCB 侧为3.3V。 我们首先提供3.3V、然后提供2.5V、如下所示。 3.3V 侧时钟信号将具有如下所示的压降(图3)。 您对 这种现象有什么想法?谢谢。

图1

图2

图3.

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    您好、Frank、

    我注意到的第一件事是、您的上升时间真的很慢。 数据表要求最大值为5ns/V 您的运行速度似乎要慢得多、大约为1ms/V

    其次、您能否在发生此干扰时提供方向引脚的示波器截图?
    这是否仅发生在您的时钟引脚上?

    谢谢!

    卡兰

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    您好、Frank、

    我看到信号是 SPI、我们有 SN74AXC4T774器件、适用于单个器件中的 SPI 电平转换。

    我们还有 SN74AXC4T245、它与 SN74AVC4T245引脚相同、在电源定序期间具有无毛刺脉冲特性。  

    从范围来看、探头是否设置为50欧姆? 请更改为1Mohm 设置。 正如 Karan 指出的、上升时间违反了 DS 设置、请纠正这种情况。 请告诉我客户选择的器件。