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[参考译文] DRV8718S-Q1EVM:无法配置 DRV8718Q1 菊花链中的第一个器件

Guru**** 2754255 points
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/motor-drivers-group/motor-drivers/f/motor-drivers-forum/1614719/drv8718s-q1evm-failed-to-configure-the-first-device-in-the-daisy-chain-of-drv8718q1

器件型号: DRV8718S-Q1EVM

您好、

如下图所示、在菊花链配置中、MCU 与三个 DRV8718 器件从外部连接。

我想将值 0x80 写入第一个器件的寄存器 IC_CTRL1 (addr =07)、然后读回该寄存器。  我收到的值实际上是 0x06。 因此数据未写入此寄存器。 这是怎么回事?

但我将 0x80 写入第二个或第三个器件的寄存器 IC_CTRL1(地址=07)、然后读回该寄存器。 该值变为 0x86。

以下是我的测试数据:

MCU SDO TXD:0x83 0x80 0x40 0x07 0x00 0x80

MCU SDI RxD:0xc0 0xc0 0xc0 0x83 0x80 0x40 0x06

MCU SDO TXD:0x83 0x80 0x40 0x47 0x00 0x00 0x00

4.MCU SDI RxD:0xc0 0xc0 0xc0 0x83 0x80 0x40 0x06

image.png

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    您好 Chou、

    感谢您发送编修。

    我想将值 0x80 写入第一个器件的寄存器 IC_CTRL1 (addr =07)、然后读回该寄存器。  我收到的值实际上是 0x06。 因此数据未写入此寄存器。 这里发生了什么?

    写入事务期间的数据回读将是该寄存器之前的内容。 如果您再次读取、则应获得新写入的值。

    [引述 userid=“679608" url="“ url="~“~/support/motor-drivers-group/motor-drivers/f/motor-drivers-forum/1614719/drv8718s-q1evm-failed-to-configure-the-first-device-in-the-daisy-chain-of-drv8718q1

    以下是我的测试数据:

    MCU SDO TXD:0x83 0x80 0x40 0x07 0x00 0x80

    MCU SDI RxD:0xc0 0xc0 0xc0 0x83 0x80 0x40 0x06

    MCU SDO TXD:0x83 0x80 0x40 0x47 0x00 0x00 0x00

    4.MCU SDI RxD:0xc0 0xc0 0xc0 0x83 0x80 0x40 0x06

    [/报价]

    测试数据显示为 1 和 2、读取器件 1 和 2 的 IC_STAT1、并将 0x80 写入器件 3 的寄存器 IC_CTRL1。 IC_STAT1 的读取值显示 POR 条件、对于器件 1 和 2 而言是正常状态。   

    接收字节的前三个字节是全部三个器件的状态信息、显示 0xC0、0xC0、0xC0 — 无故障和器件正常。 在步骤 4 中、最后一个字节应为第 3 个器件 0x80 的写入值。

    我怀疑 NSC 可能是问题所在。 您能否验证 nSCS 在事务“MCU SDO TxD:0x83 0x80 0x40 0x07 0x00 0x80“时变为低电平、并在传输最后一个字节 0x80 后、事务结束时恢复为高电平? 示波器捕获或监听器捕获会有所帮助。 写入操作在 nSCS 的上升沿发生。 如果没有发生这种情况、则不会发生写入。 但是、这不会影响 SDI 读取值。 请检查。  

    此致、Murugavel  

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    您好、

    下图显示了使用示波器捕获的波形。 是否是因为上升沿太晚导致 Device_1 的寄存器无法成功写入?

    时钟和芯片选择之间的时序为 40ns。

    2、SPI 发送最后一位和 CS 信号到空闲之间的时序为 500ns。

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    您好 Chou、

    我假设黄色通道为 SCLK、蓝色为 nSCS。 我认为、nSCS 在最后一个时钟的完整 SCLK 完成后变为高电平、比这更长是可以接受的、但 nSCS 必须变为高电平。 我们需要确保的是、SCLK 为低电平、而 nSCS 变为低电平、确切地发送 8 个字节、并且在最后一个 SCLK 低电平时间 nSCS 完成后变为高电平。 如果 SCLK 时钟下降沿的数量 (#bytes x 8) = 64、则在 nSCS 期间写入将成功、否则写入将被拒绝。   

    此致、Murugavel