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[参考译文] DRV8308：SPI SCLK计时

admin
Guru**** 2376610 points
Other Parts Discussed in Thread: DRV8308
请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/motor-drivers-group/motor-drivers/f/motor-drivers-forum/576417/drv8308-spi-sclk-timing

部件号：DRV8308

DRV8308数据表 指定了最小SPI时钟(SCLK)周期时间为62 NS (~16 MHz)。  评估板 以1 MHz的频率运行时钟。  在我们的定制硬件上，我发现传输在频率超过~2 MHz时不能正常工作。  这远远低于指定的限制。  这是否为已知 缺陷？

谢谢。

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    TI__Guru**** 2376610 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    您好，Andy：

    是写还是读有问题？ 如果读数为，您有什么值上拉电阻？ 上拉电阻会影响数据的读取。

    如果是写入，请放大交易并查找SCLK上可能被解释为额外时钟的噪音。
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    TI__Guru**** 2376610 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    Rick，

    感谢您的回复。
    当以更快的时钟(~10 MHz)运行时，读取数据看起来就像写内容的右移版本。  例如，写入0x00FF返回0x003F， 写入0x0FFF返回0x003FF。
    SCLK，SCS和 SDATAI 看起来都很干净。  SCLK没有伪边缘。  SDATO上的上拉速度 为~10k，SDATAO的上升边缘速度相当快。  我尝试使用较低的值上拉。

    Andy