[参考译文] MSP430F5659：UCS 关于时钟的问题

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请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/microcontrollers/msp-low-power-microcontrollers-group/msp430/f/msp-low-power-microcontroller-forum/623581/msp430f5659-ucs-questions-regarding-clocking

器件型号：MSP430F5659
主题中讨论的其他器件： MSP430F5529

你(们)好！

我使用的 MSP430F5659具有专用的 XIN 和 XOUT 引脚。我已经阅读了《系列用户指南》中的整个 UCS 一章、但还不能理解所有内容。
假设我们在代码中根本没有配置任何 UCS 寄存器、并且我们已为 MCU 加电：

ACLK。在启动时、它使用 XT1CLK 作为源、但由于 XT1尚不稳定、立即切换到 REFOCLK、而 SELA 仍然等于零(指向 XT1)。当 XT1稳定时、它是否会自动切换回 XT1CLK？如果没有、我们如何将其切换回 XT1？
FLLREFCLK 是否也会发生同样的情况？
我计划使用 MSP430F5529 Launchpad 中使用的相同32768Hz 晶体。 LaunchPad 添加了外部12pF 电容器、但所有示例也都设置了 XCAP_3、根据数据表将 Ceff 设置为12pF。两个外部12pF 导致 Ceff = 18pF 时为6pF + 12pF、远高于晶体所需的12.5。我的计算出了什么问题？

8 年多前

0 admin 8 年多前

TI__Guru**** 2589245 points

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您好 Andrei、

首先、必须启用 XT1、此外、在稳定振荡器后、务必确保 XT1为 ACLK 源。请参阅示例 msp430f6665x_lpm3_01.c、了解这通常是如何实现的。

2、FLLREFCLK 也是如此、当 FLL 控制环路被禁用时、清零 UCSCTL3的 SELREF 位。所有这些都在晶体振荡器稳定后发生。

c1、c2 = 2*cl-2 *杂散、其中 CL 为12.5pF、杂散约为2pF。因此、C1/C2应该大约为18pF 至21pF、这是通过外部和内部电容器组合实现的。如果您不确信、则只能使用其中一个。

此致、
Ryan

0 admin 8 年多前

TI__Guru**** 2589245 points

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您好、Ryan、

感谢您的回复！希望您不介意我是否还想了解更多详细信息。

1.是的，我看到了。但是在这个代码中、唯一将 XT1CLK 设置为 ACLK 源的东西是线路：

UCSCTL4 &=~(SELA0 + SELA1 + SELA2)； //确保 XT1为 ACLK 源

这清除了 SELA 位、但实际上它不做任何操作、因为 SELA 位默认为0。我想知道清除这些位是否有用、或者只是为了"确保"？什么实际上会强制 ACLK 从 REFO 过渡到 XT1CLK？

3.我仍然无法理解如何将外部电容器与内部电容器结合在一起。您能否将负载电容(Cload)的公式写为外部电容器(C1、C2)、杂散电容(CSTRAY)和 XCAP 位(Cmsp)选择的内部 MSP 电容的函数。比如 Cload = f (C1、C2、杂散、Cmsp)？

0 admin 8 年多前

TI__Guru**** 2589245 points

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您好 Andrei、

1.代码放置在那里是为了确保 XT1是 ACLK 源、并将强制执行此操作、除非 XT1没有正确振荡、在这种情况下、ACLK 将切换到 REFO 作为备份。

请查看 SLAA322的第2.1节： www.ti.com/.../slaa322d.pdf

此致、
Ryan

MSP 低功耗微控制器（参考译文帖）

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