[参考译文] UCC21750-Q1：RDY 行为问题

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请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

器件型号：UCC21750-Q1
主题中讨论的其他器件：UCC21750

工具/软件：

您好的团队、

客户提出了以下问题。

以下是 UCC21750 上的启动波形。 CH1=、输入 PWM、CH2=RDY 引脚、CH3=RESET 引脚、CH4=PWM VCC。 RDY 引脚上有外部上拉电阻器。我想知道当 RESET 具有短的低电平脉冲时 RDY 为什么会变为高电平、VCC 只是变为>2.85V。

这是未知条件、下表中未显示。在这种情况下、VCC 应该是 PU、VDD 是 PD、RESET 为低电平、RDY 引脚状态的正确行为是什么？

谢谢！

Ethan Wen

0 admin 3 个月前

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尊敬的 Ethan：

感谢您联系我们、您能分享相关设置（不同的引脚如何连接到客户系统中的电源）吗？

需要注意的另一个关键点是、根据波形、EN/RST ~5V 在上电期间高于 VCC (~2.8V)、这违反了 absmax 条件、因此不是有效启动条件。我们是否可以建议客户在上电期间使 EN/RST 引脚保持< VCC？

谢谢

Sasi

0 admin 3 个月前

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尊敬的 Sasi：

EN/RST 与 MCU 连接。该引脚在 MCU 上电时供电。 VCC 和 RDY 上拉源来自相同的 5V 电源轨。 VDD 与 VCC 一起启动。

已经建议客户在上电期间保持 EN/RST 引脚< VCC。

当 RDY 为低电平、VCC 为 PU、VDD 为 PD 时、您是否知道 RDY 引脚（红框中）的正确行为？

谢谢！

Ethan Wen

0 admin 3 个月前

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尊敬的 Ethan：

RDY 引脚将为高电平 RDY>UVLO 和 VDD >UVLO、在所有其他情况下、VCC 应为低电平。

但是、当 EN > VCC 时、它会进入非功能模式、因而违反器件功能行为。因此、不应使用 RDY、RDY 行为是意外的。

如果您能分享特定于栅极驱动器的客户原理图、以便我们更好地理解。

谢谢

Sasi

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