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[参考译文] TUSB1046A-DCI:TUSB1046A + TPS65987 原理图审阅

Guru**** 2609955 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/1549341/tusb1046a-dci-tusb1046a-tps65987-schematic-review

器件型号:TUSB1046A-DCI
主题中讨论的其他器件:TPS65987

工具/软件:

尊敬的 TI 团队:

我们有 TUSB1046A + TPS65987 原理图、

请您帮助查看我们的原理图吗?  此示意图与 Intel Twin Lake-N 或 Intel Panther Lake-H 平台搭配使用

我可以通过 私人消息发送原理图文件。

谢谢

Henry

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    您好 Henry:

    请将原理图发送给我。 我在 E2E 上申请了友好关系、以便我们可以 PM。

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    您好 Henry:

    请也将原理图发送给我。 如需查看 TPS65987、请使用该器件名称将原理图的相关部分提交给相关团队、因为我们的团队不涉及该器件。

    谢谢、

    Ryan

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    您好 Henry:

    对于交流电容、 TX1/2 P/N、SSRX 和 SSTX 通道上只应有 100nF 电容。 RX1/2 P/N 不需要电容器、应移除这些电容器。

    用于 3.3 I2C 的 I2C_EN 上拉。 看起来 I2C 会相应地被拉高。

    启动时、对于 EQ、所有 EQ 引脚都被下拉、默认电平为 0。 这些电平可通过 I2C 进行调整:

    否则、我没有任何其他注释。

    谢谢、

    Ryan

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    您好、Ryan、

    感谢您的帮助!

    您还能查看我们的布局吗? 我可以通过 私人消息将布局发送给您。

    谢谢

    Henry

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    您好 Henry:

    是的、我们还可以检查布局。 也可随时查看 PM。

    谢谢、

    Ryan

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    您好 Henry:

    尽管我确实注意到、您的布局看起来不错、但这似乎只是布局的一小段而已。 因此、很难判断迹线在整个过程中是否看起来良好。 如果可能、我能否获得具有完整 USB3 TX/RX 和 DP 布线的布局、以便我可以确认?

    谢谢、

    Ryan

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    您好、Ryan、

    感谢您的支持!

    我可以自己检查 USB3 TX/RX 和 DP 布线。

    顺便说一下、我们有两个布局文件(一个项目有两个 SKU)、一个已经过您的审核、另一个我稍后会提供。

    谢谢

    Henry

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    您好 Henry:

    好的。 请确保信号布线长度匹配并以差分方式一直路由到连接器。 当您有其他布局时、请告诉我。

    谢谢、

    Ryan

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    您好、Ryan、

    很抱歉、我已  通过 私人消息将其他布局文件发送给您。

    请帮助查阅。

    谢谢

    Henry

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    您好 Henry:

    我将查看此布局、并尝试在明天的 9 月 10 日 EOD 联系您。

    谢谢、

    Ryan

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    您好 Henry:

    看起来多个信号在过孔处转动 180 度。 我们强烈建议不要这样做、因为这会导致信号中发生反射。 如果可能、我们建议在过孔处将这些信号校正、以避免这些反射并提高信号质量。

    请确保差分对内延迟差也尽可能低。

    然后、总体而言、对于 SOC 和转接驱动器之间的信号路径、信号路径中似乎有很多曲线和较大的绕组。 如果可能、我们建议对于布局设计、信号保持尽可能直、仅在需要时进行弯曲。 客户有这么多曲线的原因吗?

    谢谢、

    Ryan

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    您好、Ryan、

    感谢您的帮助!

    谢谢

    Henry