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[参考译文] BQ40Z80:单元6外部平衡 FET 未打开。

Guru**** 2587365 points
Other Parts Discussed in Thread: BQ40Z80, BQSTUDIO

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/1076683/bq40z80-cell-6-external-balancing-fet-not-turning-on

部件号:BQ40Z80
“线程: 测试BQSTUDIO”中讨论的其它部件

您好,

我想知道您是否可以确认我的电路配置以实现外部平衡,特别是在第6单元周围?

我遇到了一个问题,即 Q3A 没有完全或完全打开,从而显著降低了该电池的平衡电流。

在本单元4的第一个示波器捕获中,CH1 (黄色)是 Q4A 的门,CH1 (蓝色)是 R21和 Q4A 之间的节点。  您可以看到 Q4A 在 BQ40Z80的控制下清晰地打开,如 CH2 (Q4A 漏极)被大约4伏的电压拉低,导致平衡电流流经51R 电阻器。  (请注意,这是在睡眠模式下捕获的,其中 CBS=1因此脉冲时间更长):

这就是我希望它能寻找所有正在进行平衡的细胞的方式。

在单元格6的第二次捕获中,相同节点的采样围绕 Q3A 进行。 请注意,尽管栅极被切换,但 Q3A 和 R19的节点仅下降约430mV,因此是所需平衡电流的一小部分:

在我测试的第二个电池组上,Cell 6的 FET 根本没有打开。

这些 FET 的 VGHZ 非常低,为最大。 1.2V,因此我希望它们在闸门完全打开,2V。  我怀疑存在某种偏压问题。   

请注意,示波器接地至蓄电池。  我计划在蓄电池供电范围接地至每个 FET 的电源后重复测试,以确认门源电压。

任何想法都将不胜感激!

此致,

丹尼尔

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    你好,丹尼尔,

    看来共享示意图没有正确上传,您可以尝试重新上传图像吗?

    您能否确认单元格6是仪表要平衡的单元格6? 当仪表平衡其他电池时,仪表侧的某些电池电压会波动,这就是为什么我们必须同时进行一个电池以进行外部平衡以及电池电压测量的原因。

    顺祝商祺!

    威瓦特·凯勒

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    您好,Wyatt,

    感谢您的及时回复。  是的,在这两种情况下,6号电池的巴尔时间都比所有其他电池高,电池电压也是如此(这是我调查的原因)。

    我已尝试再次附加原理图,如果出现,请告诉我。  如果没有,我可能会给你一个 pdf 吗?

    示波器捕获是否正确显示?

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    你好,丹尼尔,

    单元格之间的所有配置看起来都是一样的,所以我认为问题不在于原理图,而在于布局,但这是如此低的电流,我认为这不是问题所在。

    能否在日志之前共享 bqStudio 日志文件和.gg? 我想看看配置以及量规对细胞平衡的估计。

    我们的仪表主要使用增量容量测量来平衡单元格之间的电容,因此,如果仪表认为第6单元的电荷更大,或者电池的电荷确实更大,仪表将继续尝试平衡单元格。

    顺祝商祺!

    威瓦特·凯勒

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    您好,Wyatt,

    谢谢你。  我再次检查了 PCB 布局,看不到任何问题...轨迹反映了原理图,平衡 FET/电阻器位于单元5和6节点附近,轨迹长度小于10毫米。

    我已附加配置和日志文件。  在记录日志的同时,单元格6的平均时间与单元格5和单元格2相等,并且设置了 CB,因此我希望它能保持平衡。  无论如何,我已经观察到 Q3A 消耗的电池6平衡了数小时,并尝试更改设置以确保平衡(例如关闭 CBM,为电池组充电等), 到目前为止,我还没有看到任何迹象表明通过 FET 的电流过大(即51R 电阻器的压降)。   

    CFS 文件/__key/communityserver-discussion-components-files/196/SN011-Configuration-15-Feb-2022.gg.csv

    CFS 文件/__key/communityserver-discussion-components-files/196/SN011-15-Feb-2022.log

    我还附带了一个示波器捕获,用于演示 Q3A 门电压2Vp-p (示波器接地至节点5P (即) Q3A 源),探头尖端位于 Q3A 的门。  2V 似乎有点低(我相信我在其他电池上看到了平衡 FET 闸的4Vp-p),但它仍然足以打开 FET。  我已经购买了一些备选 FET (EM6K7T2R),其 VGSth 要测试更低,但这项测试必须等到我有时间构建新的封装。

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    你好,丹尼尔,

    启用 CBM 后,FET Vgs 电压之间不应出现4Vp-p,启用外部单元平衡时,它一次只能控制一个平衡。 如果 CBM = 0带有外部 FET,则可能导致所有外部 FET 之间的 Vgs 差异,如果这些 Vgs 重叠,则某些外部 FET 的 Vgs 会更高。

    理想情况下,外部 FET 的 Vgs 应该尽可能低,因为外部平衡基本上使用电阻器分频器来创建 Vgs,如果电芯处于3V 且需要平衡,Vgs 将大约为1.5V (外部网络中默认的1k 欧姆电阻器)。

    顺祝商祺!

    威瓦特·凯勒