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[参考译文] TPS546B24A:CAN#39;t 正常工作(通过引脚搭接配置)

Guru**** 2537080 points
Other Parts Discussed in Thread: TPS546B24A, TPS546D24A, TPS546A24A

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/1043027/tps546b24a-can-t-work-correctly-configured-by-pin-strap

器件型号:TPS546B24A
主题中讨论的其他器件: TPS546D24ATPS546A24A

您好,我使用 TPS546B24A 作为 FPGA 内核电压电源,   ‘、但 TPS546B24A 似乎无法正常工作。在我 将引脚27 (EN/UVLO)设置为高电平后、引脚1 (PGD/RST_B) 保持低电平、输出电压 如下图所示。

电阻值通过 "TPS546D24A_TPS546B24A_TPS546A24A_ExcelCalculator_SchematicLayoutChecklist.xlsx"计算、如下所示:

MSEL1 UP 2.37K( 实际焊接2.2K+160ohm 1%),Down 21.5K(实际 焊接 18K+3.6K 1%);

MSEL2向上打开,向下10K 1%;

ADRSEL 向上打开,向下10K 1%;

VSEL 向上打开,向下31.6K(实际 焊接 30K+1.5K 1%)

请帮助我找出问题所在。以下附件 是相关电路和 xlsx 文档。

您的答案将非常有帮助。

e2e.ti.com/.../6431.SCH.pdfe2e.ti.com/.../TPS546D24A_5F00_TPS546B24A_5F00_TPS546A24A_5F00_ExcelCalculator_5F00_SchematicLayoutChecklist_5F00_20200626.xlsx  

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    尊敬的 Shumei:

    我们的美国团队将进行检查、然后尽快回复您。

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    您的第一个波形组似乎显示了输出电压 放电至0.8V、然后上升至1.2V。  当针对1V 输出进行编程时、1.2V 将触发 TPS546B24A 上的过压保护。

    在第一对49.9Ω Ω 电阻器后、VOSNS 和 GOSNS 之间似乎有一个100μF μ F 电容器。  这将在反馈路径中创建一个5ms 时间常数滤波器、这比环路能够处理的相移更多。

    首先要尝试的是移除这个添加的滤波电容器、看看这是否解决了问题。  增加的反馈感应延迟很可能会导致输出电压不稳定并触发 OV 或 OC。

    如果这不能解决问题、或者如果原理图中的错误未出现在实际设计中:

    原理图中还有一条关于"感应点应直接位于位于感应点之间的负载电容器上"的注释

    输出电容器和该负载电容器感应点之间的电源路径是什么样子的?

    470μF 图仅100μF 1个470μF μ F 电容器和4个100μF μ F 电容器、但设计电子表格显示4个 μ F 和12个 μ F 电容器。  这些附加电容器位于何处?

    如果转换器上有一些局部旁路电容、并且远程旁路电容靠近负载、并且两个电容之间有一条分配路径、则分布路径中的电感与负载上的旁路电容的组合可以形成第二个滤波器、 增加环路相位延迟、从而产生环路稳定性问题。  解决这一问题的最佳方法是在第二个49.9Ω Ω 串联电阻器之后、从靠近电感器/本地输出电容器的本地输出电压添加一个电容器到 VOSNS 输入、以通过本地反馈来抵消额外的相位滞后。

    我建议从10nF 电容器开始、但该前馈路径上的确切时间常数将取决于来自本地 VOUT 和远程 Vout 的相位滞后的时间常数。

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    感谢您的耐心等待。 在我移除100uF 电容器后、输出正确,μ F、 引脚1 (PGD/RST_B) 为高电平。
    已重复检查原理图、但未发现此问题。 这个100uF 的电容  应该是100nF、我太粗心了。 再次感谢你。