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我不确定我是否理解您的问题、因为该器件的 OUT 引脚实际上是 LDO 的导通 FET 的漏极、因此不会与"输入偏置电流"相关联。 您是否正在寻找在空载条件下从 OUT 引脚流出的泄漏电流？ 如果是这样、由于器件没有外部 FB 引脚、因此在未施加负载时、我们可以预计 OUT 引脚不会流出泄漏电流。 谢谢！
