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您好!
(很抱歉经常问你。)
我们目前正在分析电路板由于性能不佳而产生的 PMIC 性能。
1. 与 TPS650864x EVM 板相比、EVM 板发现 PGNDSNS 和 CSD87381650的 GND 是单独分开并相互连接的。
(例如 PMIC 引脚40 <->路由<-> CSD87381P GND 引脚3)
另一方面、在我们的电路板上、它连接到 GND 层、而不会有任何分离。
您能告诉我们这两种情况之间的差异吗?
2. 根据数据表、FBVOUT1描述如下: 连接到输出电容的正极端子。
在我们的电路板上、FBVOUT1与反馈电阻的下一个节点相连。
问题是这样吗?
(绿色:VSYS,黄色:GPO1)
(T6508641 / PG1.0 / TI 84i / C39X G4??)
(绿色:LDO3V3,黄色:GPO1)
此致、
Geonwoo
大家好、Geonwoo、
PGNDSNSx 用于电流限制。 如果将其连接到散热焊盘 GND 而不是 LS FET GND、则电流限制电路的精度会降低、具体取决于电路板上这两个点之间的阻抗。 在调试期间、如果电流限制不准确是问题的根源、您可能需要尝试移除 ILIMx 电阻器、但通常我没有看到与此相关的客户问题。 通常、连接到散热焊盘的 AGND 是一个更大的问题、因为它可能会影响所有电源轨的精度。
如果这是 TPS6508641 OTP、FBVOUT1将使用外部反馈、因此应连接到如注释所示的反馈电阻器。 R7的另一侧应连接到输出电容器(或负载输入电容器)以实现稳定。 如果您发现5V 电源存在一些性能问题、我还建议使用与 R7并联的5pF 电容器。 该前馈电容器已帮助一些人使用该器件。
如果您有任何问题范围截图、您可以发布说明、我可以尝试提供帮助。 我这边需要注意的一点是、TPS650864系列监控所有启用的电源轨是否存在电源故障、因此、如果您看到一个电源轨关闭、它们都可能是这样的、因此很难确定哪个是根本原因。 通常、最好的方法是使用 I2C 来询问 PMIC 哪个电源轨在 PWRFAULT 寄存器中具有 PWRFAULT、但如果无法轻松访问该电源轨、 然后、在 GPOx 变为低电平之前检查哪个电源轨在上升或下降的时序通常是哪个电源轨发生电源故障的良好指示器。
感谢你的答复。 很抱歉、这个问题似乎没有具体说明。
当前使用的 PMIC (TPS6508641)工作正常。 但是、当 MPSoC 以满负载运行时、会出现一个问题、即功率会暂时下降。 如果 PMIC 输入电压为8V 或更低、则没有问题、如果超过此值、则会出现问题。 这就是我目前正在寻找在高于8V 的电压下不工作的原因的原因。 (当 MPSoC 以满负载运行时。 正常)
我计算了电流限制、电感、输出电容器、输入电容器、并将结果应用到电路板上、但结果无效。 现在、我正在阅读设计指南、我注意到了一些独特之处:
并非所有电感器、输入/输出电容器和 FET 都与 IC 位于同一电路板层。 (电感器、FET、PMIC 位于同一层。)
2. DRVLx 不会路由到与 IC 和 FET 相同的层。
3. PGNDSNS1,2,6与 GND 层合并。
4.感测线路被路由到与交换线路相同的层。
5. AGND 未与 VREF 滤波电容的 GND 相连。
AGND 未连接至专用接地岛。
AGND 与 GND 平面合并。
在提到的五件事中、我想知道是否存在降低 PMIC 性能的致命因素。
谢谢你。
大家好、Geonwoo、
在五个项目中、(1)、(2)和(3)都是最佳实践、但我对这三个项目的关注度较低-我看到很多疯狂的设计没有问题、所以我不是很担心。 (4)如果它与 SWX 网络布线、则可能会很糟糕 、但这主要是高电流开关器件(大 EMI)的问题-如果它位于 SWX 感应部分、则不会太大问题。 (5)似乎是最糟糕的、但我没有看到具体与之相关的失败。
您是否能够为电路板加电、使用 MPSoC 读取和清除任何 PMIC 中断、然后导致电路板发生故障并重新启动(我假设它重新启动?) 并再次从 PMIC 中断中读取数据?
我仍然没有提出一个很好的理由,为什么>8V 会更糟--总的来说,我们在大多数情况下看到相反的情况。 完全移除 ILIM 电阻器是否没有影响?
我已经通过读取 PMIC 中断寄存器进行了调试。
0x02、0x05、b2、b3、b4、 bb5、b6 = 0x00
之后) 0x02 = 0x88或0x08 / 0x05 = 0x06或0x04 / b2 = 0x01或0x10或0x11 / b3、b4、b5、b6 = 0x00
PMIC 输入电压8V 直接通过电源连接。 (足够的电源电流)
因此、由于 UVLO 而导致的关断毫无意义...
总之、 是否正确地看到 BUCK1和 BUCK5存在问题?
(1.2V 是很少使用的电源。 所以它更令人困惑。。)
谢谢你。
大家好、Geonwoo、
明天会查看(我的时间很晚)。
我侧的一个快速注意事项是、每次器件上电时都会设置 UVLO (因为默认情况下 UVLO 会设置 UVLO)。 如果您想确认没有 UVLO (在本例中为低风险)、则可以在"之前"阶段清除中断。
您能否在故障事件期间对这些电源轨和 SW 节点的输出进行示波器截图(如果您有3个以上的探头、则在 GPO 上触发变为低电平通常是最简单的)? BUCK1故障使我认为添加前馈电容器可能会有所帮助。 BUCK5故障有点奇怪-这个输出上的总电容是多少? 我们已经看到大于400 μ F 的问题。
您好!
我 向 BUCK1添加了一个27pF 的前馈电容、但没有特别的差异。
BUCK5的电容为22uF、100nF。
连接了 BUCK1 SW 的示波器截图。 这是 VSYS 为8.5V、7.5V、6V 时的结果。 (回答时,图片没有贴附,所以我将其附在主要问题帖子上。)
大家好、Geonwoo、
感谢您测试前馈电容器。 27pF 有点高、但如果您没有看到性能的重大变化、那么我不建议现在花更多的时间尝试其他值。
对于 BUCK5、我认为我没有低于2x22uF 电容器的测试数据-您可以尝试添加另一个22uF 电容器看看它是否有用吗?
对于 SW 节点快照、它们过大、 在关断事件期间看起来不会被执行。 请尝试在关断事件(GPOx 变为低电平)之前使用~5个脉冲进行示波器激发。
大家好、Geonwoo、
这是正确的时序、但时间刻度太大。 为了尝试了解故障发生时发生的情况、您能否将其调整为1或2 us/div 之类的值? 以便观察 SW 节点上各个脉冲的行为。
您好!
附加了 SW1的以下四个示波器截图: 1US/div、2us/div、10us/div、100us/div
(我无法将图像上传到该回复中。 我将其附在"主要问题"页面。)
感谢您的跟进。 查看示波器截图、我没有看到任何要调查的新提示。 在开关的中点期间、确实会出现相当多的噪声、但我的最佳猜测是探针从附近的电源轨接收噪声。 为了进行确认、您在 VSYS 引脚上没有看到任何输入电压振铃的迹象、对吧?
开关看起来正常、没有长脉冲(不稳定)的迹象、也没有我可以告诉的频率变化。 BUCK1 FB 是否有可能从附近的开关中拾取噪声? 下一个测试可能是尝试添加与 R8并联的100nF、看看这是否有用?
是的、 在这种情况下 VSYS 不会改变。 (已附在主页上)
正如您说过的、我将100nF 与 R8并联。 但没有区别。
BUCK1 FB 噪声? 我不知道这意味着什么。 我很抱歉。
大家好、Geonwoo、
感谢您发帖-看起来 GPO 在关闭之前正在降低、这很有趣。 它是否上拉至 LDO3P3?
您好!
LDO3P3未上拉。
在设计 TPS6508641时、我参考了 Avnet Ultra96 V1 EVM 原理图。
大家好、Geonwoo、
为了澄清这一点、我的意思是您是否具有连接到 LDO3P3的上拉电阻器的 GPO1? 如果 LDO3P3在任何时候关闭、则无法信任 PMIC 数字逻辑。 您发布的图像具有 GPO1、但电压似乎有3个不同的电平、一个初始电平、一个在关断前的最小值和一个在重新启动后的最大值。 如果将 GPO1上拉至 LDO3P3、这是我对 Ultra96的预期、那么这可能表示 LDO3P3存在问题:
您能否拍摄 PMIC 顶部显示符号的图片? 我知道我们已经在这方面工作了一段时间、我想检查您使用的硅器件的制造时间。
如果这确实显示了 LDO3P3电压、您能否获取与上述类似的 LDO3P3输出的示波器截图以确认其形状是否相同? 或任何其他异常?
您好!
GPO1上拉至 LDO3P3。
我将 PMIC 顶部的图片附加到了主页。
我 将 LDO3V3连接 到主页。
非常有趣- LDO3P3行为看起来很奇怪。
是否可以确认连接到 LDO3P3的所有网? 这种没有 VSYS 压降的 LDO3P3压降的最常见原因是 LDO3P3上的负载过大。
这是否会在多个装置上持续发生?
您好!
LDO3V3连接到的所有网络与 Ultra96几乎相同。 没有其他连接位置。(用作 CTL1、3、4、6的上拉电阻器、PMIC I2C CLK/数据、GPO1、4。 有一个与 LTC2954CDDB-1TRMPBF 关联的网络、但它在 DNP 中。)
当前问题仅在 MPSoC 以满载运行时出现。
大家好、Geonwoo、
要确认、您总共拥有多少块电路板?
谢谢你。
我很难找到这样一个原因:当 MPSoC 满载运行时、LDO3P3会下降、但只有当输入电压高于8V 时才会出现问题。 您能否提供电路板布局?
您好!
我将把布局文件发送到私人消息。
完整布局很难共享。 因此 、我将仅发送 PMIC 区域。
感谢您的辛勤工作。
大家好、Geonwoo、
感谢您发送有关布局的信息。 我已经做了全面的回顾(给您带来混乱)。 我将在底部总结一些要点以及一些后续步骤。
主要:
次要:
潜在后续步骤(按从最简单到最困难的顺序)
您好!
我非常感谢您的帮助。
电路板太小了、我不知道 我是否可以应用您说的内容。 但 我会尽可能多地进行反思。
我将向您询问您提到的一些问题。
1、 什么适合 LDOA1、LDOA2和 LDOA3中的下拉电阻值?
2. 我不明白以下的说法:这就像个人英语阅读问题。 解释起来是否容易一些?
->从 LDO3P3平面剪切 LDO3P3,将其连接到输出电容器,并从外部电源为平面供电
谢谢你。
3. 根据对 Excel 清单的答复,您所说的目标是"希望在同一层上",而是 IC 和输入电容是对的吗?
大家好、Geonwoo、
很抱歉耽误你的时间。
我的 Ω 是50mA、Ω LDOA1/2/3分别为~Ω 36 μ A、24 μ A 和24 μ A。
2.当然,让我尝试 以图形形式重新解释。 基本上、目标是从大平面断开 LDO3P3。 这可以通过使用小刀切割金属或使用小钻移除过孔来实现:
这并不容易、但我不确定如何排除 LDO3P3问题。 但是、LDO3P3输出不能悬空、它也需要一个电容器、因此您还需要尝试在那里安装一个电容器。 我的第一个想法是剪掉一些 GND 焊料、并垂直放置一个电容、然后用一根小线连接浮动 LDO3P3:
3.是的,输入电容器是第一优先事项-当它们远离 PMIC 时,会导致输入引脚上出现过大的电压振铃,这可能是一个问题。
您好!
感谢您的真诚。 我将应用您在进行 PCB 修订时所说的内容。 我不知道何时、但我会临时得出结论、PCB 插图存在问题并得出结论。 如果在 PCB 修订后问题有所改善、我将单独注释以供其他人查看。
非常感谢您迄今为止的回答。
感谢 Geonwoo 在这里所做的努力。 完成后、请随时提供更新的布局以供审核。