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[参考译文] LM3481:最低功耗 UVLO 配置

Guru**** 1831610 points
Other Parts Discussed in Thread: LM3481
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/power-management-group/power-management/f/power-management-forum/885005/lm3481-lowest-power-uvlo-configuration

器件型号:LM3481

您好!

我正在使用 LM3481设计升压转换器。 当升压转换器关闭时、我希望系统尽可能处于最低功耗状态。

有两个接地的电阻路径:

  • 反馈网络的电阻分压器
  • UVLO 接地路径(具有额外的齐纳二极管、可防止该引脚电压超过6V)

如何降低这两条路径的电流消耗?

在之前的一个请求中、我要求提供可用于反馈网络的最大电阻器、并被告知底部电阻器应小于100k。 对于我的应用(升压至12V)、这将提供 Ra = 845k、Rb = 100k 的反馈网络。 当升压至12V 时、这会将电流限制为~12.7uA。 是否有办法进一步减少这种情况? 我考虑在 RB 和接地之间添加一个 NMOS、并将栅极连接到我的 Boost_en 信号、但当 FET 关断时、FB 引脚将经历>6V (尽管这将通过 Ra)。 如果我使用 FET 来有效地禁用反馈网络、这是否会成为一个问题?

对于 UVLO 接地电阻路径、我可以在这里使用什么最大电阻值来限制电流消耗? 由于我的 VIN 大于6V、我还需要添加一个齐纳二极管来限制 UVLO 引脚电压(这将消耗额外的电流)。 我不需要使用 UVLO 功能、是否有办法在不需要接地电阻路径的情况下有效地禁用此功能?

非常感谢您提供的任何帮助。

谢谢、

Andrew

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    尊敬的 Andrew:

    感谢您提出问题并在您的应用中考虑 LM3481。

    请勿超过100kOhm。

    如果您希望在器件被禁用时最大程度地降低电流消耗、我建议使用以下电路。 当器件关断时、这将完全断开 UVLO 引脚和 FB 引脚。 它还允许您根据设计要求选择任何 UVLO 电阻器和反馈电阻器。

    如果您有任何疑问、请告诉我。

    谢谢、

    Garrett

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    您好、Garrett、

    感谢您的回复、但您的图片未显示、您能否重新上传?

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    尊敬的 Andrew:

    很抱歉。 请参阅随附的图像。

    如果您有任何疑问、请告诉我。

    谢谢、

    Garrett

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    感谢 Garrett、

    那么、对于这项工作、我假设我需要选择一个 VGS 阈值为 IO 电压负1.25V (FB 阈值电压)的 NMOS? 那么、对于3.3V 逻辑、我需要 Vgs < 2.05V 的 NMOS 吗?

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    Andrew、

    没错。

    如果您有任何其他问题、请告诉我。

    谢谢、

    Garrett