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你(们)好
我正在考虑 ZU7EV 的电源序列。
我为每个电源轨绘制了一个序列图。
e2e.ti.com/.../7658.e2e.xlsx
请检查此序列吗？ TPS650864是否可行？
贝斯特雷加兹
您好！
这看起来像是 TPS6508640 OTP 设置。 在我看来、您已经使用 TPS6508640 OTP Generator 文件来实现这一点、但如果不使用该文件、请访问 ：www.ti.com/.../swcc027
注释：
大家好、Kevin
感谢你的答复。
我随附了流程图并进行了一些更新。
e2e.ti.com/.../2804.e2e_5F00_v2.xlsx
是的、我参考 TPS6508640 OTP 设置并绘制了此序列。 我想使用 TPS6508640的默认设置。
>可能值得注意的是，BUCK2_PG 信号反映在 GPO1引脚上(与所有其他 PG 信号相比，仅在内部) 我认为 GPO1被分配为 BUCK2_PG 信号、因此如果 BUCK2 OUT 得到良好调节、它将被置为有效。 我计划将其用于外部 DCDC 使能。 当然、我确信 BUCK2_PG 也用于内部寄存器(用于启用 BUCK1)。 如果我有误解、请告诉我。
>BUCK1要求 BUCK2_PG 和 CTL4引脚为高电平。 通常情况下、CTL4引脚连接到 VCCINT_PG、但您可以将 GPO1短接至 CTL4 感谢您的通知。 流程图不正确。 CTL4连接到外部 DCDC (电源轨 A')的 VCCINT_PG。
通过 BUCK5_PG 启用>SWA1 是的。 在 BUCK5之后、SWA1将被启用。 我修改了流程图。
>LDOA1由 BUCK6_PG 启用 是的。 但 CTL1也应该置位、不应该置位？
>可能不需要将 CTL3列为 VTT 使能的一部分，CTL3是主序列使能，因此再次将其包括在内是多余的。 >我的意思是说每个电压轨都包括“& CTL3”或“& CTL3 & CTL4”，但我认为序列中显然暗示了这一点。 是的。 我知道。
>导轨 F 上的电流是否为4.6A？ 我们从 Xilinx 接收到的该电源轨的最大电流估计值为1.4A 是这样吗？ 我们对电源轨 F (MGTAVTT、VCC_PSPLL)的估算值约为4.6A。 仅 MGTAVTT 为4.46A。 我们为 ZU7EV 使用了 Xilinx 功耗估算器(XPE)。
因此、我在流程图中出错了。 (BUCK3不能提供超过3A 的电流) 我将把电源轨 F 的 BUCK3更改为由 BUCK4_PG (GPO4)启用的外部 DCDC。
但是、我对您所说的内容感兴趣。 如果 MGTAVTT 应低于1.4A、则可使用 BUCK3。 应该更好！
我只想确认您已经查看了数据表图6-4中显示加电序列的序列？
您的重新绘制与现有工程图更接近、但仍有一些差距。 例如、LDOA1从 SWA1中显示、但应该从 BUCK6中显示。
您还包含了用于 LDOA1的 CTL1、但不包含用于 BUCK6的 CTL1；VTT LDO 缺少 CTL5。
就 MGTAVTT 而言、我错误地列出了1.4A、这是针对 ZU5EV 而不是 ZU7EV。 对于 ZU7EV、Xilinx 为我们提供的值为2.1A。但是、数据来自2017年、我不知道它们是否包含所有可能的用例。 这可能是电流高得多的特殊用例。 我的建议是仔细检查它是否配置正确、但我并不是要对结果提出质疑。 正确的做法是、如果它们需要这么大的功率、BUCK3将无法支持它。 请注意、在正确的序列期间、BUCK3反馈仍需要为其施加1.2V 电压、以避免电源故障并使 PMIC 关断。
>我只想确认您已经查看了数据表图6-4中显示上电顺序的序列吗？
是的。
正如您所说、 我的图纸不精确。 我对它进行了一些修改。
e2e.ti.com/.../e2e_5F00_v3.xlsx
正如您指出的那样、我忘记了应该对 BUCK3进行调节、即使它未被使用。 我会处理这个。
关于 CTLx 引脚、
CTL1和 CTL3连接在一起 CTL2连接到"0"(GND) CTL4从 TPSM846C24连接到 VCCINT_PG CTL5连接到 LDO3P3 CTL6连接到'0'(GND)
如果您有任何疑虑、请向我提供反馈。
目前没有来自我的反馈。 如有任何其他问题、请告知我们。
感谢您的合作。 我们将推动发展。
